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【ZYNQ Ultrascale+ MPSOC FPGA教程】第十六章7寸液晶屏顯示實驗

FPGA技術(shù)專欄 ? 來源:芯驛電子科技 ? 作者:芯驛電子科技 ? 2021-01-25 09:52 ? 次閱讀
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原創(chuàng)聲明:

本原創(chuàng)教程由芯驛電子科技(上海)有限公司(ALINX)創(chuàng)作,版權(quán)歸本公司所有,如需轉(zhuǎn)載,需授權(quán)并注明出處。

適用于板卡型號:

AXU2CGA/AXU2CGB/AXU3EG/AXU4EV-E/AXU4EV-P/AXU5EV-E/AXU5EV-P /AXU9EG/AXU15EG

實驗Vivado工程為“l(fā)cd7_test”。

基于HDMI輸出實驗,本章介紹7寸液晶屏的顯示。

1.硬件介紹

7寸LCD觸摸屏模塊是由TFT 液晶屏,電容觸摸屏和驅(qū)動板組成,實物照片如下:

LCD屏的驅(qū)動時序

LCD屏顯示方式從屏幕左上角一點開始,從左向右逐點顯示,每顯示完一行,再回到屏幕的左邊下一行的起始位置,在這期間,需要對行進(jìn)行消隱,每行結(jié)束時,用行同步信號進(jìn)行同步;LCD的驅(qū)動有兩種方式,一種為HV模式,另一種為DE模式,這兩種模式都能驅(qū)動LCD屏,數(shù)據(jù)在DCLK的上升沿采樣。以下為行顯示的時序圖:

o4YBAGAKL_eAdm0fAADoTcK-1kY808.jpg

LCD行的顯示時序參數(shù)如下表所示:

o4YBAGAKL_iAcgtMAACk0JQ2_ms888.jpg

當(dāng)顯示完所有的行,形成一幀,用場同步信號進(jìn)行場同步,并使LCD顯示回到屏幕左上方,同時進(jìn)行場消隱,開始下一幀。以下為列顯示的時序圖:

pIYBAGAKL_iAIBfxAAAvU6bHMzA885.jpg

LCD列的顯示時序參數(shù)如下表所示:

o4YBAGAKL_mAN0DjAABSwVd-UCQ244.jpg

2. 程序設(shè)計

本章實驗其實很簡單,與HDMI顯示最大的不同是不需要i2c配置,輸出按照RGB即可。以下是文件結(jié)構(gòu)。

pIYBAGAKL_qAGg1FAABFh0q6EJo447.jpg

同時因為液晶屏的分辨率是800x480,需要修改video_define.v的宏定義。

pIYBAGAKL_qAHkSvAAAklAOeLnY400.jpg

同時將PLL的輸出時鐘頻率修改為33MHz,即800x480的像素時鐘。

o4YBAGAKL_uAGQrJAABxGRWKqI8639.jpg

同時在top.v中例化了ax_pwm,用于調(diào)節(jié)液晶屏的亮度,設(shè)置為200Hz,30%點空比。

pIYBAGAKL_uAN1A7AAAdutlyk38989.jpg

3.實驗現(xiàn)象

連接液晶屏到J15擴(kuò)展口,下載程序,即可看到彩條顯示。

同時也準(zhǔn)備了字符顯示的例程:

字符顯示

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