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紅綠燈的控制計(jì)算變化時(shí)間程序源代碼

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秦小姐9048

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-- MAX+plus II VHDL Example
-- Conditional Signal Assignment
-- Copyright (c) 1994 Altera Corporation

Library IEEE ;
use IEEE.std_logic_1164.all ;

ENTITY condsig IS
?PORT
?(
??input0, input1, sel?: IN? BIT;
??output????: OUT BIT
?);
END condsig;

ARCHITECTURE maxpld OF condsig IS
BEGIN

?output <= input0 WHEN sel = '0' ELSE input1;
??
END maxpld;

非常好我支持^.^

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