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三星將于今年內(nèi)完成4nm工藝開發(fā) 2020年完成3nm工藝開發(fā)

半導(dǎo)體動(dòng)態(tài) ? 來(lái)源:wv ? 作者:快科技 ? 2019-09-12 10:44 ? 次閱讀
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盡管日本嚴(yán)格管制半導(dǎo)體材料多少都會(huì)影響三星的芯片、面板研發(fā)、生產(chǎn),但是上周三星依然在日本舉行了“三星晶圓代工論壇”SFF會(huì)議,公布了旗下新一代工藝的進(jìn)展,其中3nm工藝明年就完成開發(fā)了。

三星在10nm、7nm及5nm節(jié)點(diǎn)的進(jìn)度都會(huì)比臺(tái)積電要晚一些,導(dǎo)致臺(tái)積電幾乎包攬了目前的7nm芯片訂單,三星只搶到IBM、NVIDIA及高通部分訂單。不過三星已經(jīng)把目標(biāo)放在了未來(lái)的3nm工藝上,預(yù)計(jì)2021年量產(chǎn)。

在3nm節(jié)點(diǎn),三星將從FinFET晶體管轉(zhuǎn)向GAA環(huán)繞柵極晶體管工藝,其中3nm工藝使用的是第一代GAA晶體管,官方稱之為3GAE工藝。

根據(jù)官方所說,基于全新的GAA晶體管結(jié)構(gòu),三星通過使用納米片設(shè)備制造出了MBCFET(Multi-Bridge-Channel FET,多橋-通道場(chǎng)效應(yīng)管),該技術(shù)可以顯著增強(qiáng)晶體管性能,主要取代FinFET晶體管技術(shù)。

此外,MBCFET技術(shù)還能兼容現(xiàn)有的FinFET制造工藝的技術(shù)及設(shè)備,從而加速工藝開發(fā)及生產(chǎn)。

在這次的日本SFF會(huì)議上,三星還公布了3nm工藝的具體指標(biāo),與現(xiàn)在的7nm工藝相比,3nm工藝可將核心面積減少45%,功耗降低50%,性能提升35%。

在工藝進(jìn)度上,三星今年4月份已經(jīng)在韓國(guó)華城的S3 Line工廠生產(chǎn)7nm芯片,今年內(nèi)完成4nm工藝開發(fā),2020年完成3nm工藝開發(fā)。

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