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異步FIFO用格雷碼的原因有哪些

FPGA設(shè)計(jì)論壇 ? 來源:博客園 ? 作者:子皿木公 ? 2021-08-04 14:05 ? 次閱讀
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異步FIFO通過比較讀寫地址進(jìn)行滿空判斷,但是讀寫地址屬于不同的時(shí)鐘域,所以在比較之前需要先將讀寫地址進(jìn)行同步處理,將寫地址同步到讀時(shí)鐘域再和讀地址比較進(jìn)行FIFO空狀態(tài)判斷(同步后的寫地址一定是小于或者等于當(dāng)前的寫地址,所以此時(shí)判斷FIFO為空不一定是真空,這樣更保守)。

將讀地址同步到寫時(shí)鐘域再和寫地址比較進(jìn)行FIFO滿狀態(tài)判斷(同步后的讀地址一定是小于或者等于當(dāng)前的讀地址,所以此時(shí)判斷FIFO為滿不一定是真空,這樣更保守),這樣可以保證FIFO的特性:FIFO空之后不能繼續(xù)讀取,F(xiàn)IFO滿之后不能繼續(xù)寫入。

大多數(shù)情形下,異步FIFO兩端的時(shí)鐘不是同頻的,或者讀快寫慢,或者讀慢寫快,這時(shí)候進(jìn)行地址同步的時(shí)候,可能會(huì)有地址遺漏,以讀慢寫快為例,進(jìn)行滿標(biāo)志判斷的時(shí)候需要將讀地址同步到寫時(shí)鐘域,因?yàn)樽x慢寫快,所以不會(huì)有讀地址遺漏,同步后的讀地址滯后當(dāng)前讀地址,所以可能滿標(biāo)志會(huì)提前產(chǎn)生。

進(jìn)行空標(biāo)志判斷的時(shí)候需要將寫地址同步到讀地址,因?yàn)樽x慢寫快,所以當(dāng)讀時(shí)鐘同步寫地址的時(shí)候,必然會(huì)漏掉一部分寫地址(寫時(shí)鐘快,寫地址隨寫時(shí)鐘翻轉(zhuǎn),直到滿標(biāo)志出現(xiàn)為止),那到底讀時(shí)鐘會(huì)同步到哪個(gè)寫地址?

不必在意是哪一個(gè),我們關(guān)注的是漏掉的地址會(huì)不會(huì)對FIFO的空標(biāo)志產(chǎn)生影響。比如寫地址從0寫到10,期間讀時(shí)鐘域只同步到了2,5,7這三個(gè)寫地址,漏掉了其他地址。同步到7地址時(shí),真實(shí)的寫地址可能已經(jīng)寫到10地址,相當(dāng)于“在讀時(shí)鐘域還沒來得及覺察的情況下,寫時(shí)鐘域可能偷偷寫了數(shù)據(jù)到FIFO去”,這樣在比較讀寫地址的時(shí)候不會(huì)產(chǎn)生FIFO“空”讀操作。漏掉的地址也沒有對FIFO的邏輯操作產(chǎn)生影響。

我們可以對異步FIFO的地址采用binary編碼,這樣并不影響異步FIFO的功能,前提是讀寫地址同步時(shí)能夠保持正確。這種情況在功能仿真時(shí)完全正確,問題只有到時(shí)序仿真時(shí)才會(huì)遇到。毛刺可以說是異步電路的殺手,一個(gè)毛刺被觸發(fā)器采樣后會(huì)被放大,然后傳播,導(dǎo)致電路功能出錯(cuò)。

binary編碼的地址總線在跳變時(shí)極易產(chǎn)生毛刺,因?yàn)閎inary編碼是多位跳變,在實(shí)現(xiàn)電路時(shí)不可能做到所有的地址總線等長,address bus skew必然存在,而且寫地址和讀地址分屬不同時(shí)鐘域,讀寫時(shí)鐘完全異步,這樣地址總線在進(jìn)行同步過程中出錯(cuò)不可避免,比如寫地址在從0111到1000轉(zhuǎn)換時(shí)4條地址線同時(shí)跳變,這樣讀時(shí)鐘在進(jìn)行寫地址同步后得到的寫地址可能是0000-1111的某個(gè)值,這個(gè)完全不能確定,所以用這個(gè)同步后的寫地址進(jìn)行FIFO空判斷的時(shí)候難免出錯(cuò)。

這個(gè)時(shí)候gray碼體現(xiàn)了價(jià)值,一次只有一位數(shù)據(jù)發(fā)生變化,這樣在進(jìn)行地址同步的時(shí)候,只有兩種情況:1.地址同步正確;2.地址同步出錯(cuò),但是只有1位出錯(cuò);

第一種正確的情況不需要分析,我們關(guān)注第二種,假設(shè)寫地址從000-》001,讀時(shí)鐘域同步出錯(cuò),寫地址為000-》000,也就是地址沒有跳變,但是用這個(gè)錯(cuò)誤的寫地址去做空判斷不會(huì)出錯(cuò),最多是讓空標(biāo)志在FIFO不是真正空的時(shí)候產(chǎn)生,而不會(huì)出現(xiàn)空讀的情形。

所以gray碼保證的是同步后的讀寫地址即使在出錯(cuò)的情形下依然能夠保證FIFO功能的正確性,當(dāng)然同步后的讀寫地址出錯(cuò)總是存在的(因?yàn)闀r(shí)鐘異步,采樣點(diǎn)不確定)。

這里需要注意gray碼只是在相鄰兩次跳變之間才會(huì)出現(xiàn)只有1位數(shù)據(jù)不一致的情形,超過兩個(gè)周期則不一定,所有地址總線bus skew一定不能超過一個(gè)周期,否則可能出現(xiàn)gray碼多位數(shù)據(jù)跳變的情況,這個(gè)時(shí)候gray碼就失去了作用,因?yàn)檫@時(shí)候同步后的地址已經(jīng)不能保證只有1位跳變了。

另外需要將地址總線打兩拍,這是為了避免亞穩(wěn)態(tài)傳播,理論上將打兩拍不能消除亞穩(wěn)態(tài)現(xiàn)象,因?yàn)闀r(shí)鐘異步,亞穩(wěn)態(tài)不可避免,但是可以極大降低亞穩(wěn)態(tài)傳播的概率,低頻情況下甚至STA不需要分析這里的異步時(shí)序,因?yàn)?a href="http://www.brongaenegriffin.com/tags/寄存器/" target="_blank">寄存器都可以在一拍內(nèi)將亞穩(wěn)態(tài)消除,恢復(fù)到正常0/1態(tài)。而在高頻情況下則不一定,尤其在28nm工藝以下,需要檢查兩級(jí)觸發(fā)器的延遲,保證延遲低,這樣可以提高Tr,提高系統(tǒng)MTBF。

編輯:jq

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原文標(biāo)題:異步FIFO為什么用格雷碼

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