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怎么建設高性能多核DSP+FPGA實驗室?一起來河北工程大學看看

創(chuàng)龍教儀 ? 2024-06-08 08:32 ? 次閱讀
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院校簡介

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河北工程大學是河北省重點骨干大學,河北省人民政府與水利部共建高校,河北省重點支持的國內(nèi)一流大學建設高校,河北省文明單位,坐落在中國歷史文化名城、“成語典故之都”邯鄲市。

學?,F(xiàn)有工學、理學、管理學、農(nóng)學、醫(yī)學、文學、經(jīng)濟學、法學、藝術(shù)學、教育學、歷史學11個學科門類。招生專業(yè)72個,其中工程類專業(yè)47個,占比達65.2%。擁有河北省唯一的服務國家特殊需求博士人才培養(yǎng)項目—水資源水環(huán)境調(diào)控及綜合管理,擁有河北省唯一的水利工程博士后科研流動站。工程學學科進入ESI排名全球前1%。擁有水利工程、地質(zhì)資源與地質(zhì)工程、機械工程、管理科學與工程等17個碩士學位授權(quán)一級學科

機械與裝備工程學院是河北工程大學辦學歷史最悠久的學院之一,學院設有6個教學系,建設有機械設計制造及其自動化、車輛工程、材料成型及控制工程、機器人工程、測控技術(shù)與儀器、機械電子工程(3+4)等6個本科專業(yè)。建設有1個國家級一流本科專業(yè)“機械設計制造及其自動化”,1個省級一流本科專業(yè)“車輛工程”,1個新工科專業(yè)“機器人工程”,“測控技術(shù)與儀器”專業(yè)已經(jīng)通過工程教育認證申請。

2?

實驗室狀態(tài)

創(chuàng)龍教儀聯(lián)合河北工程大學共同建設高性能DSP+FPGA教學平臺,在機械與裝備工程學院-精密測量實驗室,針對DSP+FPGA課程,探討了該課程的應用方向,制定學生課程學習的培養(yǎng)計劃。

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TL6678F-TEB相關(guān)實驗(部分)

DSP實驗環(huán)境搭建與CCS開發(fā)基礎

安裝CCS與串口調(diào)試工具

CCS工程新建、編譯和導入

DSP算法實驗

有限沖激響應濾波器(FIR)算法

無限沖激響應濾波器(IIR)算法

快速傅立葉變換(FFT)算法

一維FFT性能測試算法

圖像類實驗

圖像旋轉(zhuǎn)、縮放和反色

灰度圖像直方圖、直方圖均衡化

邊緣檢測

灰度圖像二值化

RGB24圖像灰度轉(zhuǎn)換

SYS/BIOS實驗

創(chuàng)建任務實驗

定時器控制實驗

創(chuàng)建硬件中斷實驗

執(zhí)行軟件中斷實驗

SYS/BIOS時間戳實驗

SYS/BIOS時間戳實驗

MultiCore實驗

圖像旋轉(zhuǎn)

圖像縮放

邊緣檢測

RGB24圖像灰度轉(zhuǎn)換

綜合類實驗

CameraLink 工業(yè)相機實時檢測與處理

圖像拼接、復原、超分辨率重建

目標跟蹤、人臉檢測

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參與交流的黃老師,孫老師等和學生們對TL6678F-TEB相關(guān)實驗案例表現(xiàn)出十足的熱情,并對創(chuàng)龍教儀專業(yè)的技術(shù)能力與認真的工作態(tài)度表示了肯定。


面對日新月異的技術(shù)發(fā)展,創(chuàng)龍教儀在不斷學習與探索新技術(shù)與高校新需求之間的聯(lián)系,并通過與高校間的交流學習助力高校培養(yǎng)能夠適應新社會生產(chǎn)需求的高級人才,以響應國家二十大“產(chǎn)教融合”的方針!

3?

特色案例

實驗名稱:

CameraLink工業(yè)相機實時檢測與處理綜合實驗

實驗目的:

(1)了解TI C66x DSP和Xilinx FPGA平臺的優(yōu)勢和應用。

(2)了解CameraLink工業(yè)相機和MJPEG。

(3)學習基于TI C6678 DSP和Xilinx FPGA實現(xiàn)CameraLink工業(yè)相機實時檢測與處理。

實驗原理:

CameraLink工業(yè)相機簡介

CameraLink工業(yè)相機是指具有CameraLink接口滿足工業(yè)要求的相機。CameraLink接口是由AIA協(xié)會推出的數(shù)字圖像信號串行通訊接口協(xié)議,是在ChannelLink技術(shù)基礎上發(fā)展而來的。CameraLink標準支持的最高數(shù)據(jù)傳輸率可達680MB/s。

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FPGA端作為SRIO Initiator,DSP端作為SRIO Target。FPGA端通過SRIO SWRITE和乒乓方式,將數(shù)據(jù)傳輸至DSP端的0x90000000和0x90500000的DDR地址空間。

DSP端project目錄下包括兩個工程,分別為主核工程與從核工程。主核工程編譯后默認生成的可執(zhí)行文件適用于DSP ETH1網(wǎng)口,如需重新生成適用于DSP ETH0網(wǎng)口的可執(zhí)行文件,請參考關(guān)鍵代碼小節(jié)進行源碼修改。從核工程編譯后生成的可執(zhí)行文件為srio_image_processing_slave.out。

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工程解析

Image_processing_master任務調(diào)用mc_process_init函數(shù),初始化和打開對應消息隊列,用于傳輸消息。

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默認使用DHCP模式自動獲取DSP ETH1網(wǎng)口IP地址。如需修改為靜態(tài)IP地址,或修改為使用DSP ETH0網(wǎng)口,可參考如下說明進行配置。

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本案例使用Serial RapidIO Gen2 IP核實現(xiàn)SRIO Initiator,使用HELLO(Header Encoded Logical Layer Optimized)格式,支持NREAD、NWRITE、NWRITE_R、NWRITE_R、DOORBELL、MESSG等Response Packet操作。

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實驗設備

硬件:TL6678F-TEB,CameraLink黑白相機(型號:RS-A5241-CM107-S00),CameraLink視頻采集模塊(型號:TLCameraLinkF),路由器(動態(tài)IP需要,如采用靜態(tài)IP方式可不需要)。

軟件:Vivado2017.4,CCS5.5,Windows7以上操作系統(tǒng)。

硬件連接

(1)用Micro USB串口線將PC端連接實驗主板調(diào)試串口。

(2)連接好實驗箱的電源仿真器

(3)將FPGA下載器連接開發(fā)板FPGA端JTAG接口(CON10)到PC端。

(4)打開設備管理器查看Enhanced COM port口的COM口號、查看仿真器和下載器連接是否正常。

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(5)打開并設置串口調(diào)試軟件,波特率為115200。

(6)將TLCameraLinkF模塊連接至評估板FPGA FMC2接口,評估板J1跳線帽選擇2.5V檔位,以配置FMC IO的BANK電壓為2.5V。請將CameraLink相機的CL0通過數(shù)據(jù)線連接至TLCameraLinkF模塊的CON1接口,將CameraLink相機的CL1通過數(shù)據(jù)線連接至TLCameraLinkF模塊的CON2接口。

(7)用網(wǎng)線連接實驗主板和路由器,實驗主板默認ETH1口,要保證開發(fā)板與PC端保持在同一網(wǎng)段下。

(8)撥碼開關(guān)撥到NO BOOT模式:000XX(備注:XX為1或0均可)。

(9)實驗箱上電。

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實驗現(xiàn)象

在PC機瀏覽器輸入評估板IP地址打開網(wǎng)頁界面,在網(wǎng)頁界面中選擇處理核心數(shù)量為Eight cores,選擇本案例所使用相機的最高處理幀率為107fps。

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點擊"Program Item",網(wǎng)頁將顯示經(jīng)DSP端進行Sobel(邊緣檢測)算法處理后的圖像。

同時,DSP端串口調(diào)試終端將會打印處理信息。

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4?

設備概述

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產(chǎn)品型號:TL6678F-TEB

處理器類型:TI TMS320C6678 + Xilinx Kintex-7

應用領(lǐng)域:圖像處理、信號處理、通信、自動化、航空電子、機器視覺

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
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    批分組名單,大家可以下載附件查看自己分在了哪個小組,有疑問或想要調(diào)整分組可以微信私聊小助手~ 分組名單:*附件:開源FPGA項目分組安排情況.xlsx 直播預約: 開源活動 | 一起來F
    發(fā)表于 06-06 14:05

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    的頭像 發(fā)表于 05-30 19:58 ?997次閱讀