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NVMe高速傳輸之?dāng)[脫XDMA設(shè)計(jì)20: PCIe應(yīng)答模塊設(shè)計(jì)

高速傳輸與存儲(chǔ) ? 來(lái)源:高速傳輸與存儲(chǔ) ? 作者:高速傳輸與存儲(chǔ) ? 2025-08-13 10:43 ? 次閱讀
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應(yīng)答模塊的具體任務(wù)是接收來(lái)自PCIe鏈路上的設(shè)備的TLP請(qǐng)求,并響應(yīng)請(qǐng)求。由于基于PCIe協(xié)議的NVMe數(shù)據(jù)傳輸只使用PCIe協(xié)議的存儲(chǔ)器讀請(qǐng)求TLP和存儲(chǔ)器寫(xiě)請(qǐng)求TLP,應(yīng)答模塊也分別針對(duì)兩種TLP設(shè)置處理引擎來(lái)提高并行性和處理速度。

對(duì)于存儲(chǔ)器寫(xiě)請(qǐng)求TLP,該類型的TLP使用Posted方式傳輸,即不需要返回完成報(bào)文,因此只需要接收并做處理,這一過(guò)程由寫(xiě)處理模塊來(lái)執(zhí)行,寫(xiě)處理模塊的結(jié)構(gòu)如圖1所示。

wKgZO2iQcsCAY8DCAAAd8ZyRh8Y399.png

圖1 TLP寫(xiě)處理模塊結(jié)構(gòu)圖

當(dāng)axis_cq總線中出現(xiàn)數(shù)據(jù)流傳輸時(shí),應(yīng)答模塊首先對(duì)傳輸?shù)腡LP報(bào)頭的類型字段進(jìn)行解析,如果為存儲(chǔ)器寫(xiě)請(qǐng)求則由寫(xiě)處理模塊進(jìn)一步解析。寫(xiě)處理模塊提取出TLP報(bào)頭的地址字段、長(zhǎng)度字段等,然后將數(shù)據(jù)字段寫(xiě)入數(shù)據(jù)緩存中。提取出的地址字段用于進(jìn)行地址映射,在NVMe協(xié)議中,設(shè)備端的請(qǐng)求寫(xiě)分為兩種,分別是寫(xiě)完成隊(duì)列和寫(xiě)數(shù)據(jù),因此地址映射的定向?qū)?yīng)為隊(duì)列管理模塊的完成條目處理單元和數(shù)據(jù)傳輸AXI總線的寫(xiě)通道。完成條目的字段長(zhǎng)度為128比特,因此無(wú)需進(jìn)行數(shù)據(jù)緩存,跟隨地址映射發(fā)送到隊(duì)列管理模塊。AXI Master驅(qū)動(dòng)負(fù)責(zé)將解析的字段與緩存的數(shù)據(jù)組成AXI寫(xiě)傳輸事務(wù)發(fā)送到AXI寫(xiě)通道,實(shí)現(xiàn)數(shù)據(jù)的寫(xiě)傳輸。

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審核編輯 黃宇

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    的頭像 發(fā)表于 08-04 09:53 ?581次閱讀
    <b class='flag-5'>NVMe</b> IP<b class='flag-5'>高速</b><b class='flag-5'>傳輸</b>卻不依賴<b class='flag-5'>XDMA</b>設(shè)計(jì)<b class='flag-5'>之</b>九:隊(duì)列管理<b class='flag-5'>模塊</b>(上)

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    <b class='flag-5'>NVMe</b> IP<b class='flag-5'>高速</b><b class='flag-5'>傳輸</b>卻不依賴<b class='flag-5'>XDMA</b>設(shè)計(jì)<b class='flag-5'>之</b>八:系統(tǒng)初始化

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    應(yīng)答模塊的具體任務(wù)是接收來(lái)自PCIe鏈路上的設(shè)備的TLP請(qǐng)求,并響應(yīng)請(qǐng)求。由于基于PCIe協(xié)議的NVMe數(shù)據(jù)
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    <b class='flag-5'>NVMe</b> IP<b class='flag-5'>高速</b><b class='flag-5'>傳輸</b>卻不依賴<b class='flag-5'>XDMA</b>設(shè)計(jì)之二:<b class='flag-5'>PCIe</b>讀寫(xiě)邏輯

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    <b class='flag-5'>NVMe</b> IP over <b class='flag-5'>PCIe</b> 4.0:<b class='flag-5'>擺脫</b><b class='flag-5'>XDMA</b>,實(shí)現(xiàn)超<b class='flag-5'>高速</b>!