System Generator for DSP的設(shè)計(jì)流程
Xilinx System Generator?for DSP是Simulink的一個(gè)插件，使設(shè)計(jì)人員能夠?yàn)閄ilinx FPGA開發(fā)高性能DSP系統(tǒng)。設(shè)計(jì)人員可以使用MATLAB，Simulink和Xilinx bit / cycle-true模型庫來設(shè)計(jì)和仿真系統(tǒng)。然后，該工具將自動(dòng)生成映射到Xilinx預(yù)優(yōu)化算法的可綜合硬件描述語言（HDL）代碼。然后可以合成此HDL設(shè)計(jì)，以便在Xilinx FPGA和All Programmable SoC上實(shí)現(xiàn)。因此，設(shè)計(jì)人員可以定義系統(tǒng)級(jí)設(shè)計(jì)的抽象表示，并輕松地將此單個(gè)源代碼轉(zhuǎn)換為門級(jí)表示。此外，它還提供自動(dòng)生成HDL測(cè)試平臺(tái)，可在實(shí)施時(shí)進(jìn)行設(shè)計(jì)驗(yàn)證。
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