隨著技術(shù)研究與提案工作的進(jìn)行，基站系統(tǒng)的研發(fā)也已經(jīng)開(kāi)始。本文研究工作依托于國(guó)家“863”計(jì)劃Gbps 無(wú)線傳輸關(guān)鍵技術(shù)與試驗(yàn)系統(tǒng)研究開(kāi)發(fā)項(xiàng)目，研制面向LTE-A、IMT-Advanced等未來(lái)移動(dòng)通信標(biāo)準(zhǔn)，能夠驗(yàn)證相關(guān)技術(shù)并達(dá)到標(biāo)準(zhǔn)技術(shù)指標(biāo)的新型移動(dòng)通信基站原型。

　　Gbps無(wú)線通信系統(tǒng)的算法鏈路設(shè)計(jì)

　　為滿足未來(lái)移動(dòng)通信標(biāo)準(zhǔn)的需要[3]，在算法鏈路上Gbps系統(tǒng)采用時(shí)分雙工(TDD)、多天線(MIMO)、空時(shí)編碼、正交頻分復(fù)用(OFDM)、高階調(diào)制和LDPC編碼等高性能物理層傳輸技術(shù)，以實(shí)現(xiàn)Gbps系統(tǒng)所需的高數(shù)據(jù)速率業(yè)務(wù)傳輸和高頻譜效率。以頻分、時(shí)分為主的多址方式實(shí)現(xiàn)，能夠在多天線環(huán)境下對(duì)無(wú)線資源進(jìn)行靈活調(diào)配，在兼顧實(shí)時(shí)話音傳輸?shù)耐瑫r(shí)，最大程度上滿足分組數(shù)據(jù)傳輸?shù)男枰?/p>

　　具體而言，Gbps系統(tǒng)使用3.4GHz頻段，實(shí)際帶寬100MHz，移動(dòng)臺(tái)采用2發(fā)4收的天線，基站采用4發(fā)8收的天線，OFDM子載波數(shù)為2048子載波，有效為1*子載波。圖1是Gbps無(wú)線傳輸系統(tǒng)的算法鏈路示意圖。

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　　圖 1 Gbps無(wú)線傳輸系統(tǒng)算法鏈路

　　Gbps基站系統(tǒng)的設(shè)計(jì)實(shí)現(xiàn)考慮

　　移動(dòng)通信基站往往在一個(gè)站址上同時(shí)有GSM、TD-SCDMA等多種標(biāo)準(zhǔn)的基站，越來(lái)越多地呈現(xiàn)多標(biāo)準(zhǔn)共存的局面，基站研發(fā)應(yīng)當(dāng)著眼于降低建設(shè)、運(yùn)營(yíng)維護(hù)和升級(jí)成本。對(duì)此，Gbps無(wú)線通信基站應(yīng)當(dāng)采用可重配置方式，在支持Gbps無(wú)線傳輸?shù)耐瑫r(shí)能夠兼容未來(lái)的LTE-A、IMT-Advanced標(biāo)準(zhǔn)，實(shí)現(xiàn)平滑演進(jìn)。

　　從實(shí)現(xiàn)技術(shù)上看，實(shí)現(xiàn)信號(hào)處理算法并支持可重配置需要可編程的處理器件，現(xiàn)代基站系統(tǒng)廣泛采用的可編程處理器以DSP和FPGA為主。盡管高端多核DSP的工作時(shí)鐘頻率已經(jīng)提升到1.2GHz，在TD-SCDMA基站中得到廣泛應(yīng)用，但還是無(wú)法滿足Gbps系統(tǒng)中同步、MIMO、LDPC等算法對(duì)信號(hào)處理復(fù)雜度和實(shí)時(shí)性的要求。因此，Gbps項(xiàng)目需要采用大容量的高性能FPGA來(lái)作為復(fù)雜算法的承載平臺(tái)。

　　從基站系統(tǒng)的互連與數(shù)據(jù)傳輸機(jī)制上看，互連連接所有的無(wú)線接口、網(wǎng)絡(luò)接口和計(jì)算資源，傳輸代表計(jì)算任務(wù)的數(shù)據(jù)，是使基站系統(tǒng)成為整體、協(xié)調(diào)運(yùn)行的關(guān)鍵要素。由于MIMO算法需要多天線輸入數(shù)據(jù)到多基帶處理芯片的傳輸，應(yīng)當(dāng)采用以交換式互連網(wǎng)絡(luò)和分組數(shù)據(jù)傳輸機(jī)制，更好滿足未來(lái)基站系統(tǒng)中MIMO、并行處理、動(dòng)態(tài)可重配置、計(jì)算資源動(dòng)態(tài)調(diào)度等的需要。

　　綜合以上設(shè)計(jì)實(shí)現(xiàn)考慮，經(jīng)過(guò)綜合調(diào)研考察，Gbps項(xiàng)目決定采用Xilinx公司Virtex-5系列FPGA構(gòu)架硬件系統(tǒng)平臺(tái)[4]，承載復(fù)雜的信號(hào)處理算法，采用串行RapidIO[5]技術(shù)作為板間高性能互連，采用千兆以太網(wǎng)(GE)連接業(yè)務(wù)服務(wù)器及LMT計(jì)算機(jī)。

　　Virtex-5 FPGA介紹

　　Virtex-5系列FPGA是Xilinx 率先發(fā)布和量產(chǎn)的65nm 平臺(tái)FPGA，目前包括LX、LXT、SXT、FXT及TXT等面向不同應(yīng)用的多個(gè)子系列。

　　Virtex-5系列FPGA最高工作時(shí)鐘可以達(dá)到550MHz，總邏輯單元數(shù)多達(dá)330,000個(gè)。提供了高達(dá)11.6 Mbit的靈活嵌入式Block RAM，能有效地存儲(chǔ)和緩沖各種運(yùn)算數(shù)據(jù)。多達(dá) 640個(gè)增強(qiáng)型嵌入式DSP48E slice塊，可以滿足高性能DSP算法加速的需要，實(shí)現(xiàn)352 GMACs的性能。Virtex-5 FXT系列FPGA提供多達(dá)兩個(gè)標(biāo)準(zhǔn)的PowerPC 440處理器模塊，每個(gè)處理器在550 MHz時(shí)鐘頻率下可提供1,100 DMIPS 的性能。利用PowerPC 440嵌入式處理器模塊，可快速方便地實(shí)現(xiàn)Gbps基站中復(fù)雜的控制和通信協(xié)議處理。

　　Virtex-5系列FPGA集成100Mbps–6.5Gbps的高性能收發(fā)器，配合FPGA內(nèi)部編程實(shí)現(xiàn)的串行RapidIO邏輯層模塊可以實(shí)現(xiàn)芯片間和板間高性能的數(shù)據(jù)交換互連。集成符合IEEE 802.3標(biāo)準(zhǔn)的10/100/1000Mbps以太網(wǎng)MAC硬核，連接外部GE PHY或直接使用FPGA本身的GTP/GTX，就可以實(shí)現(xiàn)高性能的千兆以太網(wǎng)接口。