由于開(kāi)關(guān)電源的開(kāi)關(guān)特性，容易使得開(kāi)關(guān)電源產(chǎn)生極大的電磁兼容方面的干擾，作為一個(gè)電源工程師、電磁兼容工程師，或則一個(gè) PCB layout 工程師必須了解電磁兼容問(wèn)題的原因已經(jīng)解決措施，特別是 layout 工程師，需要了解如何避免臟點(diǎn)的擴(kuò)大，本文主要介紹了電源 PCB 設(shè)計(jì)的要點(diǎn)。

layout與PCB的29個(gè)基本關(guān)系

1、幾個(gè)基本原理：任何導(dǎo)線都是有阻抗的;電流總是自動(dòng)選擇阻抗最小的路徑;輻射強(qiáng)度和電流、頻率、回路面積有關(guān);共模干擾和大 dv/dt 信號(hào)對(duì)地互容有關(guān);降低 EMI 和增強(qiáng)抗干擾能力的原理是相似的。

2、布局要按電源、模擬、高速數(shù)字及各功能塊進(jìn)行分區(qū)。

3、盡量減小大 di/dt 回路面積，減小大 dv/dt 信號(hào)線長(zhǎng)度（或面積，寬度也不宜太寬，走線面積增大使分布電容增大，一般的做法是：走線的寬度盡量大，但要去掉多余的部分），并盡量走直線，降低其隱含包圍區(qū)域，以減小輻射。

4、感性串?dāng)_主要由大 di/dt 環(huán)路（環(huán)形天線），感應(yīng)強(qiáng)度和互感成正比，所以減小和這些信號(hào)的互感（主要途徑是減小環(huán)路面積、增大距離）比較關(guān)鍵;容性串?dāng)_主要由大 dv/dt 信號(hào)產(chǎn)生，感應(yīng)強(qiáng)度和互容成正比，所有減小和這些信號(hào)的互容（主要途徑是減小耦合有效面積、增大距離，互容隨距離的增大降低較快）比較關(guān)鍵。

5、盡量利用環(huán)路對(duì)消的原則來(lái)布線，進(jìn)一步降低大 di/dt 回路的面積，如圖 1 所示（類似雙絞線利

用環(huán)路對(duì)消原理提高抗干擾能力，增大傳輸距離）：

圖 1 ，環(huán)路對(duì)消（ boost 電路的續(xù)流環(huán)）