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高速電路信號完整性分析與設(shè)計—時序計算

2009-10-06 | rar | 555 | 次下載 | 免費

資料介紹

高速電路信號完整性分析與設(shè)計—時序計算:基本概念
引入:在數(shù)字電路中,從一個芯片發(fā)信息A到另一個芯片變成信息B,那么這個數(shù)字系統(tǒng)失??;如何保證信息不變?關(guān)鍵點,就是在傳輸過程的任意點都保持時序的正確性。
??時序概念:在數(shù)字電路中表達一種信息狀態(tài)的一組數(shù)字信號的相位關(guān)系。
??應(yīng)用環(huán)境:數(shù)字電路
??電路組成部件:CPU、存儲器、邏輯器件
同步時序電路:所有的時鐘連接在一起,并使觸發(fā)器同時翻轉(zhuǎn),延時固定.
異步時序電路:時鐘不連接在一起,觸發(fā)器不同時翻轉(zhuǎn),延時積累。
互連設(shè)計中時序電路為同步時序電路,在這種電路中信號傳輸?shù)膶嵸|(zhì)是:在發(fā)送端,用時鐘信號從存儲器中讀出數(shù)據(jù)或地址控制信號;在接收端,用時鐘信號去鎖存數(shù)據(jù)或地址控制信號。
存儲器和鎖存器的實質(zhì)就是觸發(fā)器,所以研究觸發(fā)器的延時參數(shù)和鎖存參數(shù)是時序分析的關(guān)鍵
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