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      高速電路信號(hào)完整性分析與設(shè)計(jì)—時(shí)序計(jì)算

      2009-10-06 | rar | 555 | 次下載 | 免費(fèi)

      資料介紹

      高速電路信號(hào)完整性分析與設(shè)計(jì)—時(shí)序計(jì)算:基本概念
      引入：在數(shù)字電路中，從一個(gè)芯片發(fā)信息A到另一個(gè)芯片變成信息B，那么這個(gè)數(shù)字系統(tǒng)失敗；如何保證信息不變？關(guān)鍵點(diǎn)，就是在傳輸過(guò)程的任意點(diǎn)都保持時(shí)序的正確性。
      ??時(shí)序概念：在數(shù)字電路中表達(dá)一種信息狀態(tài)的一組數(shù)字信號(hào)的相位關(guān)系。
      ??應(yīng)用環(huán)境：數(shù)字電路
      ??電路組成部件：CPU、存儲(chǔ)器、邏輯器件
      同步時(shí)序電路：所有的時(shí)鐘連接在一起，并使觸發(fā)器同時(shí)翻轉(zhuǎn)，延時(shí)固定.
      異步時(shí)序電路：時(shí)鐘不連接在一起，觸發(fā)器不同時(shí)翻轉(zhuǎn)，延時(shí)積累。
      互連設(shè)計(jì)中時(shí)序電路為同步時(shí)序電路，在這種電路中信號(hào)傳輸?shù)膶?shí)質(zhì)是：在發(fā)送端，用時(shí)鐘信號(hào)從存儲(chǔ)器中讀出數(shù)據(jù)或地址控制信號(hào)；在接收端，用時(shí)鐘信號(hào)去鎖存數(shù)據(jù)或地址控制信號(hào)。
      存儲(chǔ)器和鎖存器的實(shí)質(zhì)就是觸發(fā)器，所以研究觸發(fā)器的延時(shí)參數(shù)和鎖存參數(shù)是時(shí)序分析的關(guān)鍵
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