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發(fā)視頻復(fù)雜數(shù)字邏輯系統(tǒng)的VerilogHDL設(shè)計(jì)技術(shù)和方法
2010-08-11 |
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資料介紹
本書從算法和計(jì)算的基本概念出發(fā)，講述把復(fù)雜算法逐步分解成簡(jiǎn)單的操作步驟，最后由硬線邏輯電路系統(tǒng)來(lái)實(shí)現(xiàn)該算法的技術(shù)和方法。這種硬線邏輯電路系統(tǒng)就是廣泛應(yīng)用于各種現(xiàn)代通訊電子設(shè)備與計(jì)算機(jī)系統(tǒng)中的專用集成電路（ASIC）或FPGA。本書著重介紹進(jìn)入九十年代后才開始在美國(guó)等先進(jìn)的工業(yè)國(guó)家逐步推廣的用硬件描述語(yǔ)言（Verilog HDL） 建模、仿真和綜合的設(shè)計(jì)方法和技術(shù)。本書可作為電子或計(jì)算機(jī)類大學(xué)本科高年極和研究生的教材，也可供在數(shù)字系統(tǒng)設(shè)計(jì)領(lǐng)域工作的工程師參考或作為自學(xué)教材。
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