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什么是TTL電平？TTL電平的詳細資料說明

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資料介紹

　　什么是ttl電平

　　TTL電平信號被利用的最多是因為通常數(shù)據(jù)表示采用二進制規(guī)定，+5V等價于邏輯“1”，0V等價于邏輯“0”，這被稱做TTL（晶體管-晶體管邏輯電平）信號系統(tǒng)，這是計算機處理器控制的設(shè)備內(nèi)部各部分之間通信的標準技術(shù)。

　　TTL電路的電平就叫TTL 電平，CMOS電路的電平就叫CMOS電平 TTL集成電路的全名是晶體管-晶體管邏輯集成電路（Transistor-Transistor Logic），主要有54/74系列標準TTL、高速型TTL（H-TTL）、低功耗型TTL（L-TTL）、肖特基型TTL（S-TTL）、低功耗肖特基型TTL（LS-TTL）五個系列。標準TTL輸入高電平最小2V，輸出高電平最小2.4V，典型值3.4V，輸入低電平最大0.8V，輸出低電平最大 0.4V，典型值0.2V。S-TTL輸入高電平最小2V，輸出高電平最?、耦?.5V，Ⅱ、Ⅲ類2.7V，典型值3.4V，輸入低電平最大0.8V，輸出低電平最大0.5V。LS-TTL輸入高電平最小2V，輸出高電平最小Ⅰ類2.5V，Ⅱ、Ⅲ類2.7V，典型值3.4V，輸入低電平最大Ⅰ類0.7V， Ⅱ、Ⅲ類0.8V，輸出低電平最大Ⅰ類0.4V，Ⅱ、Ⅲ類0.5V，典型值0.25V。TTL電路的電源VDD供電只允許在 +5V±10%范圍內(nèi)，扇出數(shù) 為10個以下TTL門電路；

　　COMS集成電路是互補對稱金屬氧化物半導(dǎo)體（Compiementary symmetry metal oxide semicoductor）集成電路的英文縮寫，電路的許多基本邏輯單元都是用增強型PMOS晶體管和增強型NMOS管按照互補對稱形式連接的，靜態(tài)功耗很小。COMS電路的供電電壓VDD范圍比較廣在+5- -+15V均能正常工作，電壓波動允許±10，當輸出電壓高于VDD-0.5V時為邏輯1，輸出電壓低于VSS+0.5V（VSS為數(shù)字地）為邏輯0，扇出數(shù)為 10--20個COMS門電路。 TTL電平信號被利用的最多是因為通常數(shù)據(jù)表示采用二進制規(guī)定，+5V等價于邏輯“1”，0V等價于邏輯“0”，這被稱做TTL（晶體管-晶體管邏輯電平）信號系統(tǒng)，這是計算機處理器控制的設(shè)備內(nèi)部各部分之間通信的標準技術(shù)。

　　TTL電平信號對于計算機處理器控制的設(shè)備內(nèi)部的數(shù)據(jù)傳輸是很理想的，首先計算機處理器控制的設(shè)備內(nèi)部的數(shù)據(jù)傳輸對于電源的要求不高以及熱損耗也較低，另外TTL電平信號直接與集成電路連接而不需要價格昂貴的線路驅(qū)動器以及接收器電路；再者，計算機處理器控制的設(shè)備內(nèi)部的數(shù)據(jù)傳輸是在高速下進行的，而TTL接口的操作恰能滿足這個要求。TTL型通信大多數(shù)情況下，是采用并行數(shù)據(jù)傳輸方式，而并行數(shù)據(jù)傳輸對于超過10英尺的距離就不適合了。這是由于可靠性和成本兩面的原因。因為在并行接口中存在著偏相和不對稱的問題，這些問題對可靠性均有影響；另外對于并行數(shù)據(jù)傳輸，電纜以及連接器的費用比起串行通信方式來也要高一些。CMOS電平和TTL電平： CMOS電平電壓范圍在3～15V，比如4000系列當5V供電時，輸出在4.6以上為高電平，輸出在0.05V以下為低電平。輸入在3.5V以上為高電平，輸入在1.5V以下為低電平。而對于TTL芯片，供電范圍在0～5V，常見都是5V，如74系列5V供電，輸出在2.7V以上為高電平，輸出在 0.5V以下為低電平，輸入在2V以上為高電平，在0.8V以下為低電平。因此，CMOS電路與TTL電路就有一個電平轉(zhuǎn)換的問題，使兩者電平域值能匹配