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      電子發(fā)燒友網(wǎng)>電子資料下載>IC datasheet pdf>SN74AUC1G74,PDF(Hex/Quadruple

      SN74AUC1G74,PDF(Hex/Quadruple

      2010-07-29 | rar | 830 | 次下載 | 3積分

      資料介紹

      These positive-edge-triggered flip-flops utilize TTL circuitry to implement D-type flip-flop logic. All have a direct-clear (CLR)\ input. The ’ALS175 and ’AS175B feature complementary outputs from each flip-flop.

      Information at the data (D) inputs meeting the setup-time requirements is transferred to the outputs on the positive-going edge of the clock pulse. Clock triggering occurs at a particular voltage level and is not directly related to the transition time of the positive-going pulse. When the clock (CLK) input is at either the high or low level, the D-input signal has no effect at the output.

      These circuits are fully compatible for use with most TTL circuits.

      Flip-Flops
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