以太網(wǎng)到多路E1適配電路設(shè)計(jì)及FPGA實(shí)現(xiàn)

摘要：介紹了一種基于現(xiàn)場(chǎng)可編程門(mén)陣列（FPGA）的以太網(wǎng)數(shù)據(jù)-多路E1反向復(fù)用器同步電路設(shè)計(jì)，分析了FPGA具體實(shí)現(xiàn)過(guò)程中的一些常見(jiàn)問(wèn)題。該設(shè)計(jì)采用VHDL硬件描述語(yǔ)言編程，可以實(shí)現(xiàn)以太網(wǎng)數(shù)據(jù)在多路E1信道中的透明傳輸，適配電路芯片內(nèi)置HDB3編解碼器和數(shù)字時(shí)鐘提取電路。

關(guān)鍵詞：FPGA 反向復(fù)用 以太網(wǎng)數(shù)據(jù) EI信道 適配電路

　　伴隨著Internet的迅速發(fā)展，IP已經(jīng)成為綜合業(yè)務(wù)通信的首選協(xié)議，其承載的信息量也在成倍增長(zhǎng)，如何利用現(xiàn)有的電信資源組建寬帶IP網(wǎng)絡(luò)是近年來(lái)研究的熱點(diǎn)。目前，比較成熟的技術(shù)主要有IP over SDH(POS)和IP over ATM（POA）。 POS將IP包直接裝入SDH的虛容器中，通道開(kāi)銷(xiāo)少、實(shí)現(xiàn)簡(jiǎn)單，具有自動(dòng)保護(hù)切換功能；POA的復(fù)接過(guò)程比較復(fù)雜，可以通過(guò)高系統(tǒng)開(kāi)銷(xiāo)提供較好的服務(wù)質(zhì)量保證（QOS）。從目前的市場(chǎng)看，各大通信設(shè)備商都推出了基于POS/POA的產(chǎn)品，但總體成本較高，主要面向的是一些高端應(yīng)用。對(duì)于帶寬需求在十幾兆以下的點(diǎn)對(duì)點(diǎn)通信而言，上述兩種技術(shù)的優(yōu)勢(shì)并不明顯。本文介紹的適配電路將以太網(wǎng)數(shù)據(jù)適配到E1信道傳輸，通過(guò)配置E1信道數(shù)量控制帶寬，針對(duì)這類(lèi)應(yīng)用提供了一種經(jīng)濟(jì)靈活的解決方案。

適配電路的一側(cè)為MII標(biāo)準(zhǔn)以太網(wǎng)MAC接口，采用100MHz/全雙工模式，另一側(cè)是8路E1 （HDB3）差分接口。發(fā)送方向?qū)⒁蕴W(wǎng)數(shù)據(jù)封裝為HDLC幀，反向復(fù)用到1～8路可配E1信道傳輸，接收方向同步多路E1，還原出以太網(wǎng)數(shù)據(jù)。帶寬從 2MHz到16MHz（1～8路E1）可配，接收側(cè)多路E1之間可以容納16毫秒的延時(shí)。