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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>CCD時序電路與數(shù)據(jù)緩存器的一體化設計

      CCD時序電路與數(shù)據(jù)緩存器的一體化設計

      2010-01-06 | rar | 223 | 次下載 | 5積分

      資料介紹

      在分析了Sarnoff 公司的VCCD512H 面陣型CCD 圖像傳感器驅(qū)動時序關(guān)系的基礎上，
      結(jié)合某CCD 相機電子系統(tǒng)的總體要求，完成了基于FPGA 驅(qū)動時序發(fā)生器與數(shù)據(jù)緩存器的一體化設計。選用Xilinx 公司的XQ2V3000 系列FPGA 作為硬件設計平臺，運用VHDL 語言對驅(qū)動時序電路和數(shù)據(jù)緩存子系統(tǒng)進行了描述，并采用Alter 公司的Quartus II 集成設計軟件對設計進行了RTL 級仿真及配置。仿真結(jié)果表明，所設計的基于FPGA 一體化時序與數(shù)據(jù)緩存子系統(tǒng)不僅可以滿足CCD 芯片和視頻處理的時序要求，還可以與CCD 相機控制系統(tǒng)進行可靠的串行通信，從而檢測和控制相機的工作狀態(tài)。
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