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??? 為了能夠更簡潔嚴(yán)謹(jǐn)?shù)孛枋鯩TM總線的主模塊有限狀態(tài)機(jī)的狀態(tài)轉(zhuǎn)換，同時(shí)減少FPGA芯片功耗，提高系統(tǒng)穩(wěn)定性，文中在分析MTM總線結(jié)構(gòu)和主模塊有限狀態(tài)機(jī)模型的基礎(chǔ)上，基于VHDL語言采用“單進(jìn)程”式對該有限狀態(tài)機(jī)進(jìn)行了設(shè)計(jì)，并在QuartusⅡ開發(fā)軟件中實(shí)現(xiàn)了對語言代碼的編譯及程序的時(shí)序仿真和功能仿真；通過對仿真波形圖的分析驗(yàn)證了該狀態(tài)機(jī)設(shè)計(jì)的正確性和有效性。
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