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      電子發(fā)燒友網(wǎng)>電子資料下載>可編程邏輯>FPGA/ASIC>基于FPGA的高階大位寬超聲相控陣濾波器設(shè)計(jì)_馬駿

      基于FPGA的高階大位寬超聲相控陣濾波器設(shè)計(jì)_馬駿

      2017-03-19 | pdf | 472KB | 次下載 | 1積分

      資料介紹

      基于FPGA的高階大位寬超聲相控陣濾波器設(shè)計(jì)_馬駿
      在大型超聲相控陣無(wú)損檢測(cè)系統(tǒng)的研制過(guò)程中, 為了降低 回波信號(hào)噪聲,對(duì)不同通道信號(hào)進(jìn)行精確延時(shí),要利用對(duì)稱有限 沖激響應(yīng)濾波器的線性相位特性, 針對(duì)超聲波陣元的頻率特性 設(shè)計(jì)內(nèi)插、全通延遲和帶通濾波器,濾波器的系數(shù)可以通過(guò)軟件 配置以適應(yīng)不同的應(yīng)用場(chǎng)合。由數(shù)字信號(hào)處理理論可知,單位樣 值響應(yīng)長(zhǎng)度為 N 的 FIR 一次濾波過(guò)程需要做 N 次有符號(hào)數(shù)的 乘法運(yùn)算和 N-1 次加法運(yùn)算。某型超聲相控陣中同時(shí)對(duì)多個(gè)孔 徑進(jìn)行處理,濾波器乘加運(yùn)算速率高達(dá) 1.6G/s。如果采用 DSP 處 理器,會(huì)帶來(lái)系統(tǒng)成本高,硬件復(fù)雜,對(duì)代碼效率要求高等問(wèn)題。 而 FPGA 由于其易于現(xiàn)場(chǎng)編程, 包含多個(gè)分布式乘加器資源等 優(yōu)勢(shì),在超聲信號(hào)處理中得到了廣泛的應(yīng)用。這種方式不僅性能 能夠達(dá)到要求,而且方便與整個(gè)信號(hào)鏈集成。
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