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      電子發(fā)燒友網>電子資料下載>模擬數字>一種低功耗Sigma-Delta調制器的設計

      一種低功耗Sigma-Delta調制器的設計

      2013-09-25 | pdf | 1.52 MB | 次下載 | 免費

      資料介紹

      采用改進的單環(huán)二階2 bit調制器架構和低功耗AB類放大器電路，實現(xiàn)了一種應用于無線收發(fā)機系統(tǒng)中的低功耗Sigma-Delta調制器。利用Matlab/Simulink進行了建模仿真，優(yōu)化調制器系數，并采用TSMC 0.18 μm CMOS工藝進行了電路設計。電路仿真結果表明, 在采樣頻率為1.228 8 MHz、過采樣率為64時，調制器的信號噪聲諧波失真比達到77.0 dB，功耗為1.18 mW，具有低功耗特點。
      調制器 Sigma-Delta
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