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在本文的第一部分里，詳細介紹了電源完整性的基本概念，以及環(huán)路電感、L×(di/dt)和工藝對電源完整性的影響等。這里，將詳細介紹電源完整性設(shè)計中的最優(yōu)IR壓降方法，以及片上電感對電源完整性所帶來的影響。另外，還將詳細介紹像45nm這類更新的工藝節(jié)點上，電源完整性經(jīng)常存在的導致器件良率下降的問題，包括呈2次方或指數(shù)式增長的L×(di/dt)噪聲，全面電源完整性技術(shù)和EDA工具的嚴重缺乏，無法清楚地理解芯片電源完整性等等。最后將討論針對上述這些問題的可能解決方法。
電源完整性
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