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      電子發(fā)燒友網(wǎng)>電子資料下載>電源技術(shù)>高電源抑制比無片外電容LDO設(shè)計

      高電源抑制比無片外電容LDO設(shè)計

      2018-02-23 | rar | 1.66 MB | 次下載 | 1積分

      資料介紹

      　　隨著集成電路制造工藝水平的迅猛發(fā)展，不同的功能模塊，比如數(shù)字，模擬，射頻電路集成在一塊芯片上。然而電源噪聲會大大削弱對噪聲敏感的電路模塊的性能，如改變VCO輸出信號的頻率和相位，所以必須通過電源管理模塊對外部電源進行處理，得到模塊所需性能標準的電壓。

      　　設(shè)計了一種可用于射頻前端芯片供電的高電源抑制比（PSR）無片外電容CMOS低壓差線性穩(wěn)壓器（LDO）?；趯θl段電源抑制比的詳細分析，提出了一種PSR增強電路模塊，使100 kHz和IMHz處的PSR分別提高了40 dB和30 dB;加入串聯(lián)RC補償網(wǎng)絡(luò)，保證了電路的穩(wěn)定性；在LDO輸出至誤差放大器輸入的反饋回路引入低通濾波模塊，降低了由于輸出端接不同負載對反饋回路的影響。

      高電源抑制比無片外電容LDO設(shè)計

      電容 電源抑制
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