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文章目錄1、時鐘約束的概念2、 DC中的時序約束參考文章時間又拖拖拖，隨著追尋DFT的進度，DC的進度在經(jīng)歷了.dynopsys_dc.setup后，就停滯不前了，接下來本文就來介紹DC的約束篇目，在我理解來看vcs是不帶時序信息的，而DC就是盡量滿足符合實際工作環(huán)境來建立一個數(shù)字電路的模型，也就是說他會盡量的接近實際的工作環(huán)境來建立模型。所以約束，就有用了，不僅僅是環(huán)境約束，告訴DC綜合出來的芯片要工作在什么環(huán)境下面等等。1、時鐘約束的概念我們必須定義時鐘周期（也就是-period這個選項）和時鐘源
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