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本文提出了一種用FPGA實(shí)現(xiàn)糾錯(cuò)編碼的設(shè)計(jì)思想，并以Altera MAX+PluslI為硬件開(kāi)發(fā)平臺(tái)。利用FPGA編程的特點(diǎn)，用軟件編程方法，很好的解決了糾錯(cuò)編碼中存在的碼速變換和實(shí)時(shí)性問(wèn)題，實(shí)現(xiàn)了(7，3)循環(huán)碼編碼過(guò)程，以及在加性噪聲中的糾錯(cuò)、譯碼過(guò)程，對(duì)整個(gè)系統(tǒng)進(jìn)行了實(shí)驗(yàn)仿真。最后，下載到自行開(kāi)發(fā)的實(shí)驗(yàn)板可編程邏輯器件上，從而完成了整個(gè)糾錯(cuò)編譯碼系統(tǒng)的開(kāi)發(fā)。
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