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隨著亞微米、深亞微米技術(shù)和系統(tǒng)芯片（SOC）技術(shù)的日益成熟，功耗已經(jīng)成為模擬電路設(shè)計(jì)中首要考慮的問(wèn)題， 低電壓低功耗集成電路設(shè)計(jì)漸漸成為主流。 因?yàn)?MOS 晶體管的襯底或者與源極相連，或者連接到 VDD 或 VSS，所以經(jīng)常被用作一個(gè)三端設(shè)備。
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