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      電子發(fā)燒友網>電子資料下載>嵌入式開發(fā)>AVS游程解碼反掃描反量化和反變換優(yōu)化設計

      AVS游程解碼反掃描反量化和反變換優(yōu)化設計

      2015-11-18 | pdf | 203KB | 次下載 | 1積分

      資料介紹

      提出了一種適用于 AVS的游程解碼、反掃描、反量化和反變換硬件結構優(yōu)化設計方案。 根據 AVS整數變換和量化的特性 , 設計了可工作在不同模式的存儲器陣列 , 既可用來進行反變 換器所需的轉置操作 , 又可用來存儲中間結果 , 將游程解碼、反掃描和反量化合并為一個流水 線單元并行處理。該設計省去了存儲中間結果所需的大量存儲器 , 加快了處理速度 , 滿足高清 視頻的處理要求。該設計通過了 FPGA驗證 , 綜合結果表明 , 其邏輯門數僅為 9076, 最高工作頻 率大于 200MHz。
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