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Verilog HDL門(mén)級(jí)結(jié)構(gòu)描述
用于門(mén)級(jí)描述關(guān)鍵字包括：not（非門(mén)）、and（與門(mén)）、 nand（與非門(mén)）、or（或門(mén)）、nor（或非門(mén)）、xor（異或門(mén)）、xnor（異或非門(mén)）、buf（緩沖器）以及bufif1、bufif0、 notif1、notif0等各種三態(tài)門(mén)。門(mén)級(jí)描述語(yǔ)句格式為 《門(mén)類型》 ［《驅(qū)動(dòng)能力》 《延時(shí)》 ］（門(mén)實(shí)例列表）； nand #10 nd1（a，data，clock，clear）; 使用了一個(gè)名為nd1的與非門(mén)，輸入為data、clock 、clear 。輸出為a，輸出與輸入的延時(shí)為10個(gè)時(shí)間單位
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