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      電子發(fā)燒友網(wǎng)>電子資料下載>嵌入式開(kāi)發(fā)>UVM實(shí)戰(zhàn)卷1 PDF電子書(shū)免費(fèi)下載

      UVM實(shí)戰(zhàn)卷1 PDF電子書(shū)免費(fèi)下載

      2019-11-29 | pdf | 6.40 MB | 次下載 | 5積分

      資料介紹

      　　《UVM實(shí)戰(zhàn)》主要介紹UVM的使用。全書(shū)詳盡介紹了UVM的factory機(jī)制、sequence機(jī)制、phase機(jī)制、objection機(jī)制及寄存器模型等的使用。此外，本書(shū)還試圖引導(dǎo)讀者思考UVM為什么要引入這些機(jī)制，從而使讀者知其然，更知其所以然。本書(shū)以一個(gè)完整的示例開(kāi)篇，使得讀者一開(kāi)始就對(duì)如何使用UVM搭建驗(yàn)證平臺(tái)有總體的概念。針對(duì)沒(méi)有面向?qū)ο?a target='_blank' class='arckwlink_none'>編程基礎(chǔ)的用戶，本書(shū)在附錄中簡(jiǎn)要介紹了面向?qū)ο蟮母拍罴癝ystemVerilog中區(qū)別于其他編程語(yǔ)言的一些特殊語(yǔ)法。

      ?

      　　uvm實(shí)戰(zhàn)內(nèi)容介紹

      　　第1章介紹了“UVM是什么”和“學(xué)了UVM之后能做什么”；

      　　第2章以一個(gè)簡(jiǎn)單的UVM驗(yàn)證平臺(tái)為例，提綱挈領(lǐng)的介紹了UVM的各個(gè)組成部分和對(duì)應(yīng)的原理；

      　　第3章到第10章再深入闡明UVM的各個(gè)組件和機(jī)理；

      　　第11章和附件分別對(duì)“OVM到UVM的遷徙”和“SystemVerilog”做了簡(jiǎn)介。
      ?

      寄存器 編程 UVM
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