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為使RISC處理器平臺(tái)具備檢測代碼重用攻擊的能力，將控制流完整性機(jī)制與可信計(jì)算中的動(dòng)態(tài)遠(yuǎn)程證明協(xié)議相結(jié)合，提出面向RISC處理器的硬件輔助控制流認(rèn)證方案。以開源RISC處理器為基礎(chǔ)，擴(kuò)展與處理器緊耦合的硬件監(jiān)控單元，同時(shí)給出控制流認(rèn)證方案的證明協(xié)議，設(shè)計(jì)用于跟蹤執(zhí)行路徑的硬件編碼方法以實(shí)現(xiàn)信息壓縮。實(shí)驗(yàn)結(jié)果表明，與C-FLAT方案相比，該方案傳輸延時(shí)小且資源消耗少，能夠保證RISC處理器控制流的可信安全。
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