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      具有清除和預(yù)設(shè)的單正邊緣觸發(fā)D型觸發(fā)器數(shù)據(jù)表

      2024-05-24 | pdf | 893.98KB | 次下載 | 免費(fèi)

      資料介紹

      　　預(yù)置(PRE)或清零(CLR)輸入的低電平將設(shè)置或重置輸出，而與其他輸入的電平無關(guān)。當(dāng)PRE和CLR是無效的(高)，在數(shù)據(jù)(D)輸入滿足設(shè)置時間要求的數(shù)據(jù)被轉(zhuǎn)移到上的時鐘脈沖的正沿輸出。時鐘觸發(fā)發(fā)生在電壓電平，并且與時鐘脈沖的上升時間沒有直接關(guān)系。在保持時間間隔之后，D輸入端的數(shù)據(jù)可以在不影響輸出端的電平的情況下改變。

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