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許多高性能混合信號產品，如高速模數轉換器 (ADC) 和 數模轉換器 (DAC)、捷變射頻 (RF) 收發(fā)器、時鐘、專用集 成電路 (ASIC) 和現場可編程門陣列 (FPGA) 等，需要超低 噪聲、低壓差 (LDO) 線性穩(wěn)壓器來提供干凈電源，從而最 大程度地提高信號鏈性能。對更多集成功能和更低功耗的 高要求，使得這些大規(guī)?；旌闲盘?a target='_blank' class='arckwlink_none'>集成電路 (IC) 的設計工 藝尺寸越來越?。ɡ?8 nm或更小），以便容納更多晶體 管。這種趨勢同樣影響了電源要求。近年來，內核電源電 壓持續(xù)降低，但為了支持更多模擬或數字功能，負載電流 顯著提高（例如3 A以上）。
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