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為了校準(zhǔn)相控陣?yán)走_(dá)的接收信道，設(shè)計(jì)出一種基于DDS的弱信號(hào)源。采用單片機(jī)和FPGA控制DDS芯片AD9852產(chǎn)生脈沖線性調(diào)頻與單頻連續(xù)波信號(hào)，單片機(jī)的并口接口提供初始化DDS的寄存器設(shè)置， FPGA提供DDS的寄存器地址及控制信號(hào)，更主要的是提供時(shí)序控制脈沖觸發(fā)信號(hào)源的輸出和關(guān)斷。結(jié)果表明，信號(hào)源可以輸出幅度為-45 dBm、雜散優(yōu)于70 dB的弱信號(hào)，完全滿足校準(zhǔn)相控陣?yán)走_(dá)接收信道的性能要求，而且具有結(jié)構(gòu)簡(jiǎn)單、可編程、可擴(kuò)展、性能好、系統(tǒng)穩(wěn)定及實(shí)用性強(qiáng)等優(yōu)點(diǎn)。該設(shè)計(jì)同樣適用于其他多信道接收工程。
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