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代碼

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代碼就是程序員用開發(fā)工具所支持的語(yǔ)言寫出來(lái)的源文件，是一組由字符、符號(hào)或信號(hào)碼元以離散形式表示信息的明確的規(guī)則體系。

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代碼技術(shù)

從MySQL到ClickHouse實(shí)時(shí)復(fù)制與實(shí)現(xiàn)

ClickHouse 可以掛載為 MySQL 的一個(gè)從庫(kù) ，先全量再增量的實(shí)時(shí)同步 MySQL 數(shù)據(jù)，這個(gè)功能可以說是今年最亮眼、最剛需的功能，基于它我...

2023-01-03 標(biāo)簽：數(shù)據(jù)庫(kù)代碼 MySQL 1.2k 0

一文闡述Redis分布式鎖的10個(gè)坑

為了避免并發(fā)請(qǐng)求造成的庫(kù)存超賣等問題，我們一般會(huì)用到Redis分布式鎖。

2022-12-29 標(biāo)簽：代碼 Redis 853 0

詳解Spyglass使用(二）

接著上文繼續(xù)聊，詳解Spyglass使用(一)，在看到一條條lint Warning信息后，怎么才能更清晰地知道warning的具體原因呢？告訴你一個(gè)好習(xí)慣！

2022-12-29 標(biāo)簽：WINDOWS 代碼 GUI 6.5k 0

什么是FBGA代碼，F(xiàn)BGA解碼器使用體驗(yàn)

因?yàn)榉庋b工藝帶來(lái)的空間限制，Micron 為其產(chǎn)品統(tǒng)一制定了兩段五位數(shù)的代碼，其中第二排的代碼就是 FBGA Code，這個(gè) FBGA Code 跟芯片...

2022-12-28 標(biāo)簽：解碼器 FlaSh 存儲(chǔ)器 7k 0

形式驗(yàn)證入門之基本概念和流程

VLSI設(shè)計(jì)的功能驗(yàn)證有兩種方法，動(dòng)態(tài)仿真驗(yàn)證和形式驗(yàn)證。形式驗(yàn)證采用數(shù)學(xué)方法來(lái)比較原設(shè)計(jì)和修改設(shè)計(jì)之間的邏輯功能的異同，而動(dòng)態(tài)仿真驗(yàn)證是對(duì)兩設(shè)計(jì)施加相...

2022-12-27 標(biāo)簽：形式驗(yàn)證代碼 VLSI 3.3k 0

如何獲得100%的安全關(guān)鍵系統(tǒng)結(jié)構(gòu)代碼覆蓋率

許多軟件開發(fā)和驗(yàn)證工程師其實(shí)并不能真正理解獲得結(jié)構(gòu)覆蓋率的重要性。大部分人這么做只是因?yàn)檫@是他們行業(yè)的功能標(biāo)準(zhǔn)所要求的，而并沒有真正認(rèn)真對(duì)待它。

2022-12-26 標(biāo)簽：匯編語(yǔ)言代碼結(jié)構(gòu)化 1.7k 0

feign調(diào)用常見問題避坑指南！

摘要：主要是總結(jié)了一下這段時(shí)間在使用 feign 的過程中的遇到的一些坑點(diǎn)。

2022-12-23 標(biāo)簽：代碼線程 2.9k 0

解析OneFlow BatchNorm相關(guān)算子實(shí)現(xiàn)

可以看到 CUDNN_BATCHNORM_PER_ACTIVATION 被用于非卷積層，在OneFlow中只有當(dāng)輸入Tensor的維度為2時(shí)才選取這種模...

2022-12-23 標(biāo)簽：代碼算子 CUDA 1.1k 0

什么是良好的Verilog代碼風(fēng)格？

1. 前言之前在公司負(fù)責(zé)制定代碼規(guī)范，費(fèi)了九牛二虎之力，終于整理出來(lái)一份文檔。由于保密規(guī)定的緣故，無(wú)法與大家直接分享這份文檔，但是文檔中的大部分規(guī)范都...

2022-12-22 標(biāo)簽：Verilog 代碼 1.3k 0

C語(yǔ)言注釋要注意幾點(diǎn)

如果領(lǐng)導(dǎo)給你一個(gè)項(xiàng)目的源碼讓你閱讀，并理解重構(gòu)代碼，但里面一句注釋都沒有，我想這肯定是之前同事“刪庫(kù)跑路”了。

2022-12-22 標(biāo)簽：C語(yǔ)言源碼代碼 667 0

使用Svelte來(lái)構(gòu)建Web Component（超簡(jiǎn)單方便）

每個(gè)開發(fā)人員都應(yīng)該關(guān)注代碼中的可重用性以及代碼的業(yè)務(wù)隔離，這樣可以讓業(yè)務(wù)邏輯與應(yīng)用架構(gòu)分離，提升系統(tǒng)的擴(kuò)展性。而 Web Component 就是這樣一...

2022-12-19 標(biāo)簽：Web 代碼 javascript 1.6k 0

C語(yǔ)言while(1)和for(;;)的區(qū)別

有讀者提出了類似這樣的問題：while(1) 和 for(;;) 它們不都是無(wú)限循環(huán)嗎，作用應(yīng)該一樣啊，它們到底有什么區(qū)別？

2022-12-19 標(biāo)簽：C語(yǔ)言代碼編譯器 1.7k 0

觀海微GH8555BL_BOE7.0(TV070WXU-NW0/BP070WX2-100)搭配原理及代碼

觀海微GH8555BL_BOE7.0(TV070WXU-NW0/BP070WX2-100)搭配原理及代碼。

2022-12-15 標(biāo)簽：電路圖原理代碼 2.2k 0

觀海微GH8555BL+BOE6.95（TV070WSQ-T80）搭配原理及代碼

觀海微GH8555BL+BOE6.95（TV070WSQ-T80）搭配原理如下：觀海微GH8555BL+BOE6.95（TV070WSQ-T80）參考...

2022-12-14 標(biāo)簽：芯片 IC 代碼 1.9k 0

如何將JavaScript代碼嵌入HTML頁(yè)面

本教程向您展示如何將JavaScript代碼嵌入HTML頁(yè)面，來(lái)幫助您開始學(xué)習(xí) JavaScript。

2022-12-14 標(biāo)簽：HTML 代碼 javascript 1.6k 0

鏈表的基本操作

回看了一下以前寫的鏈表操作，確實(shí)有點(diǎn)復(fù)雜不利于初學(xué)，這篇文章就換個(gè)寫法，簡(jiǎn)單明了的介紹鏈表的操作。

2022-12-13 標(biāo)簽：代碼結(jié)構(gòu)體鏈表 1.8k 0

如何利用ChatGPT幫你寫代碼？

最近爆火的ChatGpt相信大家都不陌生，聽說它還能寫代碼，而且能力不凡。作為合格的嵌入式軟件工程師，必須得充分利用起來(lái)！

2022-12-13 標(biāo)簽：ip地址代碼腳本 5.9萬(wàn) 0

dart命名參數(shù)與位置參數(shù)的區(qū)別

經(jīng)常搞不清楚dart命名參數(shù)與位置參數(shù)的區(qū)別？現(xiàn)在我們來(lái)對(duì)比一下，位置參數(shù)與命名參數(shù)的區(qū)別。

2022-12-09 標(biāo)簽：參數(shù)代碼 Dart 1.8k 0

從RTL追蹤到Scala

　　在三天前SpinalHDL1.8.0正式上線，在這次更新中增加了Scala代碼和生成的RTL代碼之間的對(duì)照功能，也就是說我們可以在生成的RTL代碼中...

2022-12-09 標(biāo)簽：RTL 代碼 scala 1.7k 0

你寫的代碼是如何跑起來(lái)的？

今天我們來(lái)思考一個(gè)簡(jiǎn)單的問題，一個(gè)程序是如何在 Linux 上執(zhí)行起來(lái)的？

2022-12-08 標(biāo)簽：Linux 程序代碼 1.3k 0

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

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FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門檻降低，即使沒有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫程序。
AD10

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識(shí)別

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FPGA開發(fā)板

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FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長(zhǎng)的，而許多汽車制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車。
PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
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PCB封裝庫(kù)

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Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
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面包板是由于板子上有很多小插孔，專為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
candence

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AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性價(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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