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標(biāo)簽 > 時鐘域
時鐘域就是時鐘信號的“勢力范圍“,一個時鐘域里只能存在一個時鐘信號,但是一個時鐘信號最多可以對應(yīng)兩個時鐘域。
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參數(shù)REG_OUTPUT用于確定是否對最終輸出信號寄存;參數(shù)RST_USED用于確定是否使用復(fù)位信號;參數(shù)SIM_ASSERT_CHK則用于確定是否顯示...
采用格雷碼異步FIFO跟標(biāo)準(zhǔn)FIFO有什么區(qū)別
異步FIFO包含"讀"和"寫“兩個部分,寫操作和讀操作在不同的時鐘域中執(zhí)行,這意味著Write_Clk和Read_Clk的...
即使 “打兩拍”能阻止“亞穩(wěn)態(tài)的傳遞”,但亞穩(wěn)態(tài)導(dǎo)致后續(xù)FF sample到的值依然不一定是符合預(yù)期的值,那 “錯誤的值” 難道不依然會向后傳遞,從而造...
2022-10-19 標(biāo)簽:元器件亞穩(wěn)態(tài)時鐘域 1612 0
report_cdc 可以報告設(shè)計中所有的 cdc 路徑并將其分類(前提是時鐘被約束好),我們可以基于該報告來檢查設(shè)計中是否有不安全的 cdc 路徑。
本篇博文中的分析是根據(jù)真實客戶問題撰寫的,該客戶發(fā)現(xiàn)在現(xiàn)場出現(xiàn)罕見的比特翻轉(zhuǎn), 本篇博文旨在演示用于縮小根本原因范圍以及修復(fù)此問題的部分調(diào)試技巧。
在很久之前便陸續(xù)談過亞穩(wěn)態(tài),F(xiàn)IFO,復(fù)位的設(shè)計。本次亦安做一個簡單的總結(jié),從宏觀上給大家展示跨時鐘域的解決方案。
2024-01-08 標(biāo)簽:FPGA設(shè)計fifoCDC 1230 0
valid-ready握手協(xié)議和enable-xoff協(xié)議對比
這一篇主要對比下valid-ready握手協(xié)議和enable-xoff協(xié)議,當(dāng)然這個對比僅限于同時鐘域下的信號傳輸。
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