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標(biāo)簽 > 賽靈思
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賽靈思平臺(tái)開發(fā)高級(jí)副總裁 Victor Peng 暢談 Vivado
面向未來十年All Programmable,一個(gè)以IP及系統(tǒng)為中心的工具套件,把可編程系統(tǒng)的集成度和實(shí)現(xiàn)速度提升至原來的4倍。賽靈思公司(Xilinx...
FPGA構(gòu)造勘察技巧 FPGA Editor提升效率的小訣竅
工程師在設(shè)計(jì)過程中,經(jīng)常需要一定的創(chuàng)造力(你不妨稱之為數(shù)字管道膠帶)才能夠保證設(shè)計(jì)的順利完成。過去8年時(shí)間里,我曾經(jīng)目睹許多優(yōu)秀工程師利用這一方法出色地...
基于UltraScale+FPGA可編程邏輯DCI互連盒設(shè)計(jì)
隨著實(shí)施基于云的服務(wù)和機(jī)器到機(jī)器通信所產(chǎn)生的數(shù)據(jù)呈指數(shù)級(jí)增長(zhǎng),數(shù)據(jù)中心面臨重重挑戰(zhàn)....
異構(gòu)多處理器產(chǎn)品系列在嵌入式評(píng)估板上實(shí)現(xiàn)
本實(shí)驗(yàn)工程將介紹如何利在賽靈思異構(gòu)多處理器產(chǎn)品系列 Zynq UtralScale+ MPSoC ZCU102 嵌入式評(píng)估板上實(shí)現(xiàn)多個(gè) UIO,同時(shí)借...
2018-02-26 標(biāo)簽:賽靈思異構(gòu)多處理器zcu102 8430 0
賽靈思以客戶為導(dǎo)向_用FPGA助力中國AI創(chuàng)新創(chuàng)業(yè)浪潮
在AI算法尚不成熟的時(shí)候,可編程的靈活性給予了FPGA一定的市場(chǎng)優(yōu)勢(shì)。 但是,隨著目前AI算法進(jìn)一步成熟,各類全定制化的AI芯片開始陸續(xù)出現(xiàn),比如搭載了...
如何利用可編程邏輯實(shí)現(xiàn)數(shù)據(jù)中心互連 DCI互連盒架構(gòu)解讀
隨著實(shí)施基于云的服務(wù)和機(jī)器到機(jī)器通信所產(chǎn)生的數(shù)據(jù)呈指數(shù)級(jí)增長(zhǎng),數(shù)據(jù)中心面臨重重挑戰(zhàn)。如何使可編程邏輯實(shí)現(xiàn)數(shù)據(jù)中心互連至關(guān)重要。
數(shù)據(jù)中心使用 DCI 這樣的技術(shù)使之間的互連變得越來越緊密
為支持?jǐn)?shù)據(jù)中心間的通信,需要使用非常大的數(shù)據(jù)管道,同時(shí),用于在這些管道間傳輸數(shù)據(jù)的網(wǎng)絡(luò)通常稱為數(shù)據(jù)中心互連 (DCI)。
2018-02-03 標(biāo)簽:賽靈思數(shù)據(jù)中心可編程邏輯 1.2萬 0
賽靈思 Zynq UltraScale+ MPSoC 上的 Xen 管理程序教程
通過這篇有趣的教程,熟悉運(yùn)行在賽靈思 Zynq UltraScale+ MPSoC 上的 Xen 管理程序。 賽靈思和 DornerWorks 的系統(tǒng)軟...
對(duì)于一款新的Zynq板卡來說,如何開掛啟動(dòng)程序
當(dāng)新入手一款Zynq開發(fā)板后,一般新手在串口輸出一個(gè)hello world,實(shí)現(xiàn)功能就可以了。而對(duì)于一些對(duì)于Zynq有一定了解的老手而言,往往則會(huì)去嘗試...
沒有直接可用的Pmod驅(qū)動(dòng)?傳授你一招填坑秘籍
為了實(shí)現(xiàn)這一點(diǎn)我們需要閱讀官方的Pmod接口標(biāo)準(zhǔn)文檔來確保SPI管腳與Pmod橋輸入管腳之間正確的映射。
2018-01-17 標(biāo)簽:賽靈思傳感模塊Pmod驅(qū)動(dòng) 9254 0
賽靈思FPGA卷積神經(jīng)網(wǎng)絡(luò),云中的機(jī)器學(xué)習(xí)
人工智能正在經(jīng)歷一場(chǎng)變革,這要得益于機(jī)器學(xué)習(xí)的快速進(jìn)步。在機(jī)器學(xué)習(xí)領(lǐng)域,人們正對(duì)一類名為“深度學(xué)習(xí)”算法產(chǎn)生濃厚的興趣,因?yàn)檫@類算法具有出色的大數(shù)據(jù)集...
2018-07-11 標(biāo)簽:FPGA賽靈思機(jī)器學(xué)習(xí) 2906 0
如何利用LUT來實(shí)現(xiàn)FPGA中的DSP功能
查找表 (LUT) 實(shí)質(zhì)上是一個(gè)存儲(chǔ)元件,能夠根據(jù)任何給定的輸入狀態(tài)組合,“查找”輸出,以確保每個(gè)輸入都有確切的輸出。采用LUT來實(shí)現(xiàn) DSP功能具有一...
賽靈思 ISE 12設(shè)計(jì)套件利用智能時(shí)鐘門控技術(shù)將動(dòng)態(tài)功耗降低30% 1)賽靈思今天要宣布什么消息? ISE? 12設(shè)計(jì)套件不僅實(shí)現(xiàn)了功耗與成本的突破性...
基于BFM測(cè)試和調(diào)試的Zynq SoC設(shè)計(jì)步驟及架構(gòu)詳解
AXI 總線功能建??珊?jiǎn)化Zynq-7000 All Programmable SoC 組件及子系統(tǒng)的驗(yàn)證工作。本文以賽靈思工具鏈為基礎(chǔ),通過逐步指導(dǎo)...
使用賽靈思的功耗估計(jì)器和分析器工具協(xié)助功耗優(yōu)化的步驟有哪些?
FPGA與眾多其它類型組件的不同之處在于,其核心電壓、輔助電壓和I/O電壓電源需求取決于設(shè)計(jì)實(shí)現(xiàn)。因此,確定應(yīng)用中FPGA的功耗比數(shù)據(jù)手冊(cè)描述的情況更...
借助FPGA開發(fā)SoC原型制作平臺(tái)(Xilinx的Zynq為例)
對(duì)于使用安謀國際(ARM)處理器的系統(tǒng)單芯片(SoC)設(shè)計(jì)者而言,在原型制作的階段經(jīng)常會(huì)面臨如何整合處理器的問題。本文以賽靈思(Xilinx)的Zynq...
Xylon的新款logiVID-ZU視覺開發(fā)套件,平臺(tái)開發(fā)多樣化,有效提高開發(fā)效率
在科技發(fā)展的潮流中,我們不僅需要更好的功能,更需要更好的用戶體驗(yàn)。關(guān)于汽車我們需要自動(dòng)駕駛,關(guān)于機(jī)器人我們需要他們能夠像人類一樣能夠看清周圍的世界,關(guān)于...
為什么這些公司都采用 7 納米工藝的 CCIX 測(cè)試芯片
賽靈思、Arm、Cadence和臺(tái)積公司今日宣布計(jì)劃在 2018 年交付 7 納米 FinFET 工藝芯片。這一測(cè)試芯片旨在從硅芯片層面證明 CCIX ...
2017-09-25 標(biāo)簽:賽靈思 7177 0
利用reVISION? 堆棧實(shí)現(xiàn)應(yīng)用算法
監(jiān)控系統(tǒng)嚴(yán)重依靠嵌入式視覺系統(tǒng)提供的功能加速在廣泛市場(chǎng)和系統(tǒng)中的部署。這些監(jiān)控系統(tǒng)的用途非常廣泛,包括事件和流量監(jiān)控、安全與安防用途、ISR 和商業(yè)智能...
賽靈思用定點(diǎn)數(shù)實(shí)現(xiàn)信號(hào)處理鏈
賽靈思器件和工具支持從二進(jìn)制到雙精度在內(nèi)的多種數(shù)據(jù)類型。UltraScale ? 架構(gòu)的可擴(kuò)展精度提供極大靈活性,便于優(yōu)化功耗和資源利用,同時(shí)滿足設(shè)計(jì)性...
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