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AMD Vivado Design Tool綜合中的門控時鐘轉(zhuǎn)換

傳統(tǒng)上，使用門控時鐘是 ASIC 設(shè)計中降低系統(tǒng)功耗的常見方法。通過門控時鐘，可在非必要時阻止整組寄存器的狀態(tài)轉(zhuǎn)換。

2025-05-14 標(biāo)簽：FPGA amd 寄存器 1.8k 0

QDMA Subsystem for PCI Express v5.0產(chǎn)品指南

AMD QDMA Subsystem for PCI Express（ PCIe ）旨在利用多隊列的概念實現(xiàn)高性能 DMA，以搭配 PCI Expres...

2025-05-13 標(biāo)簽：amd 存儲器 UltraScale 574 0

使用ALINX VD100開發(fā)板實現(xiàn)圖像處理

這是一塊基于 AMD Versal Edge AI 平臺的開發(fā)板，功能特別強(qiáng)大，可以用來做圖像處理、人工智能等各種高階應(yīng)用。

2025-05-12 標(biāo)簽：FPGA amd 圖像處理 723 0

ZU+RFSoC之RFDC API介紹和使用

RF Data Converters驅(qū)動API是AMD Xilinx為RFSoC提供的一套軟件接口，用于控制Data Converters(RF-ADC...

2025-04-16 標(biāo)簽：amd 接口 Xilinx 2.3k 0

TPS536C5 用于AMD平臺的 12 相數(shù)字降壓多相控制器數(shù)據(jù)手冊

TPS536C5 是一款完全符合 AMD SVI3 標(biāo)準(zhǔn)的降壓控制器，具有雙通道、內(nèi)置非易失性存儲器（NVM）和 PMBus? 接口，并與 TI N...

2025-03-20 標(biāo)簽：amd 存儲器降壓控制器 636 0

關(guān)于eDP的介紹

最新的 DisplayPort TX/RX 1.4 Subsystem IP v3.1 支持 eDP v1.4b，支持下面的 eDP features。

2025-03-13 標(biāo)簽：amd 硬件命令 1.3k 0

借助PerfXCloud和dify開發(fā)代碼轉(zhuǎn)換器

隨著深度學(xué)習(xí)與高性能計算的迅速發(fā)展，GPU計算的廣泛應(yīng)用已成為推動技術(shù)革新的一股重要力量。對于GPU編程語言的選擇，CUDA和HIP是目前最為流行的兩種...

2025-02-25 標(biāo)簽：轉(zhuǎn)換器 amd 代碼 1.2k 0

AMD Vivado Design Suite IDE中的設(shè)計分析簡介

本文檔涵蓋了如何驅(qū)動 AMD Vivado Design Suite 來分析和改善您的設(shè)計。

2025-02-19 標(biāo)簽：amd 內(nèi)核設(shè)計套件 790 0

AMD Versal自適應(yīng)SoC器件Advanced Flow概覽（下）

在 AMD Vivado Design Suite 2024.2 版本中，Advanced Flow 自動為所有 AMD Versal 自適應(yīng) SoC ...

2025-01-23 標(biāo)簽：amd soc 命令 1.1k 0

AMD Versal自適應(yīng)SoC器件Advanced Flow概覽（上）

在最新發(fā)布的 AMD Vivado Design Suite 2024.2 中，引入的新特性之一是啟用了僅適用于 AMD Versal 自適應(yīng) SoC ...

2025-01-17 標(biāo)簽：amd soc 可編程邏輯 1k 0

PAM4 PRBS測試簡介

本文為 AMD Versal 自適應(yīng) SoC 器件和 AMD UltraScale Plus 的 PAM4 PRBS 測試簡介。

2025-01-15 標(biāo)簽：amd 以太網(wǎng)soc 2.5k 0

AMD Versal自適應(yīng)SoC DDRMC如何使用Micron仿真模型進(jìn)行仿真

AMD Versal 自適應(yīng) SoC 器件上 DDR4 硬核控制器 DDRMC 跑仿真時，按照 IP 的默認(rèn)設(shè)置，在 IP wizard 中使能了“In...

2025-01-10 標(biāo)簽：amd 控制器 soc 1.2k 0

使用AMD Vitis進(jìn)行嵌入式設(shè)計開發(fā)用戶指南

由于篇幅有限，本文僅選取部分內(nèi)容進(jìn)行分享。 Vitis 簡介 AMD Vitis 工具套件包含多種設(shè)計技術(shù)，用于開發(fā)以 AMD 器件（例如，AMD Ve...

2025-01-08 標(biāo)簽：amd 嵌入式設(shè)計 Vitis 1.9k 0

AMD 通過第二代 Versal 器件為 AI 驅(qū)動型嵌入式系統(tǒng)提供單芯片智能

隨著嵌入式 AI、視頻和控制應(yīng)用的爆炸式增長，對異構(gòu)處理的需求越來越大，以便在狹小的區(qū)域和功率限制內(nèi)加速端到端計算。多芯片處理解決方案具有巨大的功耗、面...

2024-11-29 標(biāo)簽：amd 嵌入式系統(tǒng)單芯片 1.3k 0

AMD Versal自適應(yīng)SoC GTM如何用XSIM仿真和觀察PAM4信號

PAM4(4-Level Pulse Amplitude Modulation) 的全稱是四電平脈沖幅度調(diào)制，通過種不同的電平進(jìn)行信號傳輸，每個電平幅度...

2024-11-22 標(biāo)簽：amd 仿真信號 1.3k 0

多平臺FPGA工程快速移植與構(gòu)建

作為一名FPGA工程師，經(jīng)常需要在多個FPGA設(shè)備之間移植項目，核心的問題是IP的管理和移植，今天通過安裝和使用 FuseSoC 在多個 AMD FPG...

2024-11-20 標(biāo)簽：FPGA amd Xilinx 2.3k 0

U50的AMD Vivado Design Tool flow設(shè)置

AMD Alveo 加速卡使用有兩種流程，AMD Vitis Software Platform flow 和 AMD Vivado Design To...

2024-11-13 標(biāo)簽：amd 接口加速卡 1.2k 0

MicroBlaze V軟核處理器的功能特性

本指南提供了有關(guān) AMD Vivado Design Suite 中包含的 32 位和 64 位 MicroBlaze V 軟核處理器的信息。該文檔旨在...

2024-10-16 標(biāo)簽：處理器 amd 嵌入式 1.3k 0

AMD EPYC處理器助力阿里云AnalyticDB性能升級

阿里云瑤池旗下的云原生數(shù)倉AnalyticDB for PostgreSQL與AMD新一代硬件深度優(yōu)化，結(jié)合全自研計算引擎及行列混合存儲實現(xiàn)性能升級，...

2024-09-19 標(biāo)簽：處理器 amd 服務(wù)器 1k 0

基于VDMA的遠(yuǎn)程圖像采集系統(tǒng)參考設(shè)計

本文參考設(shè)計基于 AMD ZYNQ 7000 Device，使用 VDMA 做原始圖像采集系統(tǒng)，在 Petalinux 下做服務(wù)器，通過 Socket...

2024-09-18 標(biāo)簽：amd Xilinx 服務(wù)器 1.3k 0

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