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fpga設(shè)計(jì)

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

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fpga設(shè)計(jì)資訊

FPGA設(shè)計(jì)與應(yīng)用之基于AD9833芯片的信號(hào)發(fā)生器設(shè)計(jì)

2019-03-26 標(biāo)簽：FPGA設(shè)計(jì)DDS芯片狀態(tài)機(jī) 1706 0

FPGA，你為什么這么牛？

2018-07-02 標(biāo)簽：fpga FPGA設(shè)計(jì) 200 0

FPGA，你為什么這么牛？

2018-07-02 標(biāo)簽：fpga FPGA設(shè)計(jì) 135 0

震撼！FPGA實(shí)現(xiàn)負(fù)反饋控制純數(shù)字鎖相環(huán)！

2018-03-07 標(biāo)簽：FPGA設(shè)計(jì) 477 0

全硬件TCP/IP協(xié)議棧學(xué)習(xí)筆記（第八天：W5500+FPGA實(shí)現(xiàn)tcp連接）

經(jīng)歷了一個(gè)多月的調(diào)試，最終終于使用basys2將tcp模式配置成功了。首先說(shuō)一下思路吧，首先W5500的發(fā)送與接收與開(kāi)發(fā)板的通信使用的是SPI協(xié)議，下...

2017-12-18 標(biāo)簽：FPGA設(shè)計(jì)tcp 1.2萬(wàn) 0

全硬件TCP/IP協(xié)議棧學(xué)習(xí)筆記（第七天：FPGA+W5500 PING通）

在一周多的時(shí)間，從軟件的協(xié)議到芯片接口最后到硬件描述，我覺(jué)得是時(shí)候試一試芯片了，看一看能不能ping通。兩天時(shí)間終于完成第一次ping，也挺不容易的。 ...

2017-12-18 標(biāo)簽：FPGA設(shè)計(jì)tcp 9294 0

全硬件TCP/IP協(xié)議棧學(xué)習(xí)筆記（第六天：SPI通信協(xié)議學(xué)習(xí)一）

今天我們學(xué)習(xí)一下W5500使用的通訊接口，SPI協(xié)議。SPI，中文串行外圍設(shè)備接口，SPI總線是在物理上是通過(guò)接在外圍設(shè)備微控制單元上的同步串行端口的模...

2017-12-18 標(biāo)簽：FPGA設(shè)計(jì) 5368 0

全硬件TCP/IP協(xié)議棧學(xué)習(xí)筆記（第五天：全硬件TCP/IP協(xié)議應(yīng)用層學(xué)習(xí)）

繼續(xù)昨天的設(shè)置端口TX/RX存儲(chǔ)信息，每個(gè)端口的基地址和屏蔽地址在這里確定并保存。W5500有一個(gè)通用寄存器，8個(gè)Socket寄存器去，以及對(duì)應(yīng)每個(gè)S...

2017-12-18 標(biāo)簽：FPGA設(shè)計(jì) 4867 0

FPGA設(shè)計(jì)的基本原則、技巧與時(shí)序電路設(shè)計(jì)

FPGA設(shè)計(jì)的基本原則面積與速度折衷原則面積和速度是ASIC芯片設(shè)計(jì)中一對(duì)相互制約、影響成本和性能的指標(biāo)，貫穿FPGA設(shè)計(jì)的始終。在FPGA設(shè)計(jì)中，...

2017-11-25 標(biāo)簽：FPGA設(shè)計(jì) 1280 0

圖像自適應(yīng)分段線性拉伸算法的FPGA設(shè)計(jì)

由于紅外圖像的成像機(jī)理以及紅外成像自身的原因，紅外圖像有對(duì)比度低、圖像較模糊、噪聲大等特點(diǎn)。因此抑止噪聲，提高圖像信噪比，以及調(diào)整紅外圖像對(duì)比度，以利于...

2017-11-25 標(biāo)簽：FPGA設(shè)計(jì) 1184 0

通過(guò)一個(gè)實(shí)例具體介紹ISE中通過(guò)編輯UCF文件來(lái)對(duì)FPGA設(shè)計(jì)進(jìn)行約束

摘要：本文主要通過(guò)一個(gè)實(shí)例具體介紹ISE中通過(guò)編輯UCF文件來(lái)對(duì)FPGA設(shè)計(jì)進(jìn)行約束，主要涉及到的約束包括時(shí)鐘約束、群組約束、邏輯管腳約束以及物理屬性約...

2017-11-25 標(biāo)簽：fpga FPGA設(shè)計(jì)ise 5712 0

成功解決FPGA設(shè)計(jì)時(shí)序問(wèn)題的三大要點(diǎn)

FPGA的設(shè)計(jì)與高速接口技術(shù)可以幫助你滿(mǎn)足今天的市場(chǎng)要求，但也提出了一些有趣的設(shè)計(jì)挑戰(zhàn)。為了確保存儲(chǔ)器接口的數(shù)據(jù)傳輸準(zhǔn)確，在超過(guò)200兆赫茲以上，進(jìn)行時(shí)...

2017-11-25 標(biāo)簽：FPGA設(shè)計(jì) 1375 0

基于FPGA設(shè)計(jì)時(shí)效仿真技術(shù)的驗(yàn)證以及其應(yīng)用

隨著FPGA器件體積和復(fù)雜性的不斷增加，設(shè)計(jì)工程師越來(lái)越需要有效的驗(yàn)證方。時(shí)序仿真可以是一種能發(fā)現(xiàn)最多問(wèn)題的驗(yàn)證方法，但對(duì)許多設(shè)計(jì)來(lái)說(shuō)，它常常是最困難...

2017-11-24 標(biāo)簽：fpga FPGA設(shè)計(jì)時(shí)效仿真 1397 0

關(guān)于FPGA設(shè)計(jì)的驗(yàn)證技術(shù)及其應(yīng)用原則分析和介紹

FPGA設(shè)計(jì)和驗(yàn)證工程師當(dāng)今面臨的最大挑戰(zhàn)之一是時(shí)間和資源制約。隨著FPGA在速度、密度和復(fù)雜性方面的增加，完成一個(gè)完整時(shí)序驗(yàn)證對(duì)人力和計(jì)算機(jī)處理器、存...

2019-10-06 標(biāo)簽：FPGA設(shè)計(jì)存儲(chǔ)器時(shí)序 1365 0

基于FPGA設(shè)計(jì)環(huán)境中加時(shí)序約束的詳細(xì)分析與優(yōu)化結(jié)果

在給FPGA做邏輯綜合和布局布線時(shí)，需要在工具中設(shè)定時(shí)序的約束。通常，在FPGA設(shè)計(jì)工具中都FPGA中包含有4種路徑：從輸入端口到寄存器，從寄存器到寄存...

2017-11-24 標(biāo)簽：fpga FPGA設(shè)計(jì)時(shí)序約束 1839 0

具體介紹ISE中通過(guò)編輯UCF文件來(lái)對(duì)FPGA設(shè)計(jì)進(jìn)行約束

本文主要通過(guò)一個(gè)實(shí)例具體介紹ISE中通過(guò)編輯UCF文件來(lái)對(duì)FPGA設(shè)計(jì)進(jìn)行約束，主要涉及到的約束包括時(shí)鐘約束、群組約束、邏輯管腳約束以及物理屬性約束。 ...

2017-11-24 標(biāo)簽：fpga FPGA設(shè)計(jì) 3868 0

FPGA設(shè)計(jì)中的時(shí)序問(wèn)題的詳細(xì)分析與解決方案

耗費(fèi)數(shù)月精力做出的設(shè)計(jì)卻無(wú)法滿(mǎn)足時(shí)序要求，這確實(shí)非常令人傷心。然而，試圖正確地對(duì)設(shè)計(jì)進(jìn)行約束以保證滿(mǎn)足時(shí)序要求的過(guò)程幾乎同樣令人費(fèi)神。找到并確定時(shí)序約束...

2017-11-24 標(biāo)簽：fpga FPGA設(shè)計(jì)時(shí)序問(wèn)題 1.0萬(wàn) 0

基于賽靈思FPGA設(shè)計(jì)的整體時(shí)序具有完全可重復(fù)性

滿(mǎn)足設(shè)計(jì)的時(shí)序要求本身已非易事，而要實(shí)現(xiàn)某項(xiàng)設(shè)計(jì)的整體時(shí)序具有完全可重復(fù)性有時(shí)候卻是不可能的任務(wù)。幸運(yùn)的是，設(shè)計(jì)人員可以借助有助于實(shí)現(xiàn)可重復(fù)時(shí)序結(jié)果的...

2017-11-24 標(biāo)簽：fpga FPGA設(shè)計(jì)可重復(fù)時(shí)序 868 0

直接擴(kuò)頻通信同步系統(tǒng)的xilinx FPGA設(shè)計(jì)原理分析

對(duì)直接擴(kuò)頻通信同步系統(tǒng)進(jìn)行了研究，使用PN碼作為擴(kuò)頻序列，利用其良好的自相關(guān)性，提出一種新式的滑動(dòng)相關(guān)法使收發(fā)端同步，并給出該系統(tǒng)的FPGA實(shí)現(xiàn)方法...

2017-11-24 標(biāo)簽：fpga FPGA設(shè)計(jì)通信 1497 0

利用MCU和FPGA設(shè)計(jì)車(chē)載信息娛樂(lè)系統(tǒng)的系統(tǒng)架構(gòu)與應(yīng)用

汽車(chē)工業(yè)蓬勃發(fā)展，車(chē)載信息娛樂(lè)系統(tǒng)已經(jīng)不再是豪華轎車(chē)的獨(dú)有設(shè)施，越來(lái)越多的中低端轎車(chē)開(kāi)始擁有自己的信息娛樂(lè)系統(tǒng)。然而，車(chē)載信息娛樂(lè)系統(tǒng)是一個(gè)高度集成的復(fù)...

2017-11-24 標(biāo)簽：fpga mcu FPGA設(shè)計(jì) 1932 0

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Protues

Protues

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Proteus軟件是英國(guó)Lab Center Electronics公司出版的EDA工具軟件（該軟件中國(guó)總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
靜電防護(hù)

靜電防護(hù)

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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對(duì)生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
Altium Designer

Altium Designer

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FPGA芯片

FPGA芯片

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FPGA（Field－Programmable Gate Array），即現(xiàn)場(chǎng)可編程門(mén)陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。
ArduBlock

ArduBlock

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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運(yùn)行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會(huì)使編程的可視化和交互性加強(qiáng)，編程門(mén)檻降低，即使沒(méi)有編程經(jīng)驗(yàn)的人也可以嘗試給Arduino控制器編寫(xiě)程序。
AD10

AD10

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識(shí)別

識(shí)別

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FPGA開(kāi)發(fā)板

FPGA開(kāi)發(fā)板

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FPGA開(kāi)發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來(lái)實(shí)現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車(chē)工業(yè)正面臨新的設(shè)計(jì)挑戰(zhàn)。過(guò)去汽車(chē)電子產(chǎn)品的開(kāi)發(fā)周期是漫長(zhǎng)的，而許多汽車(chē)制造商現(xiàn)正致力于在更短的時(shí)間內(nèi)，裝備消費(fèi)者所需的新一代汽車(chē)。
PCB封裝

PCB封裝

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pcb封裝就是把實(shí)際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長(zhǎng)寬，直插，貼片，焊盤(pán)的大小，管腳的長(zhǎng)寬，管腳的間距等）用圖形方式表現(xiàn)出來(lái)，以便可以在畫(huà)pcb圖時(shí)進(jìn)行調(diào)用。
QUARTUS II

QUARTUS II

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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開(kāi)發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計(jì)輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計(jì)輸入到硬件配置的完整PLD設(shè)計(jì)流程。
語(yǔ)音交互

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PCB封裝庫(kù)

PCB封裝庫(kù)

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AD09

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PDN

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QuickPcb

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Artix-7

Artix-7

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　　Artix-7 系列：相對(duì)于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半，成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿(mǎn)足低成本大批量市場(chǎng)的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對(duì)的市場(chǎng)領(lǐng)域。
VHDL代碼

VHDL代碼

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Protel 99 se

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powerlink

powerlink

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candence

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面包板

面包板

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面包板是由于板子上有很多小插孔，專(zhuān)為電子電路的無(wú)焊接實(shí)驗(yàn)設(shè)計(jì)制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時(shí)間，而且元件可以重復(fù)使用，所以非常適合電子電路的組裝、調(diào)試和訓(xùn)練。
AXI

AXI

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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對(duì)齊的數(shù)據(jù)傳輸，同時(shí)在突發(fā)傳輸中，只需要首地址，同時(shí)分離的讀寫(xiě)數(shù)據(jù)通道、并支持Outstanding傳輸訪問(wèn)和亂序訪問(wèn)，并更加容易進(jìn)行時(shí)序收斂。AXI是AMBA中一個(gè)新的高性能協(xié)議。
特性阻抗

特性阻抗

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特性阻抗又稱(chēng)特征阻抗，它不是直流電阻，屬于長(zhǎng)線傳輸中的概念。特性阻抗是射頻傳輸線影響無(wú)線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會(huì)阻礙交變電流的流動(dòng)，合稱(chēng)阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
時(shí)鐘源

時(shí)鐘源

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時(shí)鐘源用來(lái)為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時(shí)鐘脈沖信號(hào)。它通常由石英晶體振蕩器和與非門(mén)組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
AD采樣

AD采樣

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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時(shí)間的倒數(shù)，模擬量可以是電壓、電流等電信號(hào)，也可以是壓力、溫度、濕度、位移、聲音等非電信號(hào)；而AD分辨率指數(shù)字量變化一個(gè)最小量時(shí)模擬信號(hào)的變化量。
驅(qū)動(dòng)電流

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Kintex-7

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　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價(jià)格實(shí)現(xiàn)與其相當(dāng)性能，性?xún)r(jià)比提高了一倍，功耗降低了一半。
Protel DXP

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FPGA教程

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紅外觸摸屏

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