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fpga設(shè)計

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FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進(jìn)一步發(fā)展的產(chǎn)物。

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fpga設(shè)計資訊

基于VHDL語言并選用FPGA設(shè)計了一個卷積碼編碼器

數(shù)字信號在有噪聲的信道中傳輸時，由于受到干擾的影響，會發(fā)生誤碼。在設(shè)計數(shù)字通信系統(tǒng)時，首先應(yīng)合理設(shè)計基帶信號，選擇調(diào)制、解調(diào)方式，并采用均衡措施等，使誤...

2017-11-24 標(biāo)簽：fpga FPGA設(shè)計 vhdl 2336 0

關(guān)于FPGA設(shè)計中的亞穩(wěn)態(tài)及其緩解措施的分析和介紹

在進(jìn)行FPGA設(shè)計時，往往只關(guān)心“0”和“1”兩種狀態(tài)。然而在工程實踐中，除了“0”、“1”外還有其他狀態(tài)，亞穩(wěn)態(tài)就是其中之一。亞穩(wěn)態(tài)是指觸發(fā)器或鎖存器...

2019-10-06 標(biāo)簽：濾波器 FPGA設(shè)計同步器 1490 0

關(guān)于基于FPGA設(shè)計的步進(jìn)電機(jī)控制系統(tǒng)的介紹

步進(jìn)電機(jī)是一種將電脈沖信號變換成相應(yīng)的角位移或直線位移的機(jī)電執(zhí)行機(jī)構(gòu)。控制步進(jìn)電機(jī)的輸入脈沖數(shù)量、頻率及電機(jī)各相繞組的接通順序,可以得到各種需要的運行特...

2019-10-06 標(biāo)簽：機(jī)器人 FPGA設(shè)計步進(jìn)電機(jī) 5004 0

關(guān)于賽靈思高層次綜合工具加速FPGA設(shè)計的介紹和分享

Vivado HLS配合C語言等高級語言能幫助您在FPGA上快速實現(xiàn)算法。高層次綜合（HLS）是指自動綜合最初用C、C++或SystemC語言描述的數(shù)...

2019-10-06 標(biāo)簽：FPGA設(shè)計觸發(fā)器數(shù)據(jù)流 1513 0

關(guān)于FPGA設(shè)計中使用CORDIC算法的教程分享

雖然CORDIC 是實現(xiàn) DSP 和數(shù)學(xué)函數(shù)最重要的算法之一，但許多設(shè)計人員并不熟悉。作者：Adam P. Taylor 首席工程師阿斯特里姆公司 ...

2019-10-06 標(biāo)簽：FPGA設(shè)計計算機(jī)函數(shù) 2118 0

關(guān)于4路視頻合成系統(tǒng)的FPGA設(shè)計的分析和應(yīng)用

隨著人們越來越注重安全問題，監(jiān)控開始向小型化、家庭化發(fā)展。為了實現(xiàn)全方位多角度監(jiān)控，需要采用多路攝像及多個顯示器來顯示實時信息,同時多路存儲的容量需求比...

2019-10-06 標(biāo)簽：FPGA設(shè)計數(shù)據(jù)處理視頻處理 1346 0

基于FPGA設(shè)計的軟件無線電平臺：WARP

開發(fā)一種新的無線傳輸技術(shù)是一個復(fù)雜的過程。最初是新技術(shù)的理論，概念的形成?；靖拍钚纬芍?，工程師開始采用模擬，仿真的方式來評估新技術(shù)所帶來的好處。第三...

2017-11-21 標(biāo)簽：fpga FPGA設(shè)計無線電 3405 0

FPGA框架與FPGA設(shè)計規(guī)則

鑒于FPGA在如此多應(yīng)用中的重要地位，采取正式且注重方法的開發(fā)流程來處理FPGA設(shè)計比以往更加重要。該流程旨在避免開發(fā)周期后期因發(fā)現(xiàn)設(shè)計缺陷而不得不進(jìn)行...

2017-11-18 標(biāo)簽：fpga FPGA設(shè)計 1997 0

Cadence OrCAD FPGA System Planner為在PCB板的FPGA設(shè)計提供支持

Cadence OrCADFPGA System Planner為FPGA和PCB之間的協(xié)同設(shè)計提供了一種全面的、可擴(kuò)展的解決方案，它能使用戶創(chuàng)建一個正...

2017-11-17 標(biāo)簽：fpga pcb FPGA設(shè)計 6312 0

FPGA設(shè)計約束技巧之XDC約束之I/O篇（下）

XDC中的I/O約束雖然形式簡單，但整體思路和約束方法卻與UCF大相徑庭。加之FPGA的應(yīng)用特性決定了其在接口上有多種構(gòu)建和實現(xiàn)方式，所以從UCF到XD...

2017-11-17 標(biāo)簽：fpga FPGA設(shè)計 xdc 7709 0

FPGA設(shè)計約束技巧之XDC約束之I/O篇（上）

從UCF到XDC的轉(zhuǎn)換過程中，最具挑戰(zhàn)的可以說便是本文將要討論的I/O約束了。 I/O 約束的語法 XDC 中可以用于 I/O 約束的命令包括 set_...

2017-11-17 標(biāo)簽：fpga FPGA設(shè)計 xdc 1.3萬 0

基于LV FPGA設(shè)計濾波器步驟詳解

對于NI很多專注于數(shù)據(jù)采集領(lǐng)域的客戶來說，對采集到的信號在前端加入濾波功能是非常常見的需求。但是，可能由于他們對NI產(chǎn)品不夠了解，不知道這部分功能完全可...

2017-11-15 標(biāo)簽：fpga FPGA設(shè)計 7557 0

fest on Demand：12門基于FPGA設(shè)計的在線技術(shù)課程（可免費注冊）

作者：Steve Leibson, 賽靈思戰(zhàn)略營銷與業(yè)務(wù)規(guī)劃總監(jiān) ?Avnet 和Xilinx推出了一項技術(shù)培訓(xùn)計劃X-fest On-Demand，該...

2017-02-09 標(biāo)簽：FPGA設(shè)計 438 0

S2C將FPGA設(shè)計原型帶入云端：Prodigy完整原型設(shè)計平臺能處理任何規(guī)模的工程

作者：Steve Leibson, 賽靈思戰(zhàn)略營銷與業(yè)務(wù)規(guī)劃總監(jiān) ?想開發(fā)一款能在多個地理位置處理任何設(shè)計規(guī)模的FPGA原型系統(tǒng)么？那么，最好擬定一個大...

2017-02-09 標(biāo)簽：FPGA設(shè)計 718 0

在FPGA設(shè)計中，時序就是全部

當(dāng)你的FPGA設(shè)計不能滿足時序要求時，原因也許并不明顯。解決方案不僅僅依賴于使用FPGA的實現(xiàn)工具來優(yōu)化設(shè)計從而滿足時序要求，也需要設(shè)計者具有明確目標(biāo)和...

2017-02-09 標(biāo)簽：FPGA設(shè)計 400 0

關(guān)于利用Device DNA實現(xiàn)FPGA設(shè)計的介紹和說明

Xilinx所有的FPGA器件都有Device DNA，這是一個57bit的二進(jìn)制序列，在器件生產(chǎn)的時候燒死到芯片里面，每個芯片都是唯一的。這個序列，用...

2019-10-12 標(biāo)簽：芯片 FPGA設(shè)計 1488 0

針對Xilinx Zynq-7000 All Programmable SoC實現(xiàn)了一個圖像化FPGA設(shè)計和編程的環(huán)境

背景：早在2014年，All Programmable技術(shù)和器件的全球領(lǐng)先的Xilinx公司聯(lián)手生態(tài)合作伙伴德國Silicon Software公司推...

2017-01-13 標(biāo)簽：FPGA設(shè)計 SoC Xilinx 2560 0

Synopsys與Lattice Semiconductor續(xù)簽多年期FPGA設(shè)計軟件OEM協(xié)議

Lattice Semiconductor軟件質(zhì)量和戰(zhàn)略合作伙伴關(guān)系高級總監(jiān)Choon-Hoe Yeoh說：“我們與Synopsys長期合作關(guān)系的延續(xù)讓...

2016-07-06 標(biāo)簽：FPGA設(shè)計汽車電子 Synopsys 1939 0

美高森美Libero SoC v11.7版本軟件增強FPGA設(shè)計的安全性、使用性和效率并加快上市速度

致力于在功耗、安全、可靠和性能方面提供差異化半導(dǎo)體技術(shù)方案的領(lǐng)先供應(yīng)商美高森美公司（Microsemi Corporation，紐約納斯達(dá)克交易所代號：...

2016-03-30 標(biāo)簽：FPGA FPGA設(shè)計美高森美 1638 0

FPGA設(shè)計因需而變向新融合時代進(jìn)發(fā)

半導(dǎo)體技術(shù)已經(jīng)進(jìn)入了新的發(fā)展時期。目前，28nm芯片容量足以滿足整個系統(tǒng)需求，節(jié)省了功率組件和存儲器。如果說哪一類產(chǎn)品的成長率超過半導(dǎo)體行業(yè)平均增長率，...

2012-08-14 標(biāo)簽：FPGA FPGA設(shè)計賽靈思 3662 1

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Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風(fēng)標(biāo)電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機(jī)及外圍器件。
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為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進(jìn)行靜電中和等。
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ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強，編程門檻降低，即使沒有編程經(jīng)驗的人也可以嘗試給Arduino控制器編寫程序。
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pcb封裝就是把實際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進(jìn)行調(diào)用。
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Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計輸入到硬件配置的完整PLD設(shè)計流程。
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AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進(jìn)行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
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時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
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　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
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