完善資料讓更多小伙伴認(rèn)識你,還能領(lǐng)取20積分哦,立即完善>
標(biāo)簽 > ip核
IP就是知識產(chǎn)權(quán)核或知識產(chǎn)權(quán)模塊的意思,在EDA技術(shù)開發(fā)中具有十分重要的地位。美國著名的Dataquest咨詢公司將半導(dǎo)體產(chǎn)業(yè)的IP定義為“用于ASIC或FPGA中的預(yù)先設(shè)計(jì)好的電路功能模塊”。
文章:247個 瀏覽:50322次 帖子:249個
PCI-Express(peripheral component interconnect express)是一種高速串行計(jì)算機(jī)擴(kuò)展總線標(biāo)準(zhǔn),它原來的名...
賽靈思--縮短開發(fā)時(shí)間,支持高速模數(shù)/數(shù)模串行接口
賽靈思公司無線通信副總裁Sunil Kar指出:“我們很高興我們的產(chǎn)品能成為NEC iPASOLINK毫米波通信系統(tǒng)的一部分,并助力構(gòu)建出高可靠性網(wǎng)絡(luò)系統(tǒng)。
2019-07-24 標(biāo)簽:數(shù)據(jù)傳輸IP核移動無線網(wǎng)絡(luò) 2448 0
賽靈思軟件通過調(diào)整編譯參數(shù)以及運(yùn)行并行編譯來優(yōu)化FPGA時(shí)序性能
萬幸的是,當(dāng)今FPGA工具(比如Xilinx的 Vivado)都有很多開關(guān)和設(shè)置選項(xiàng)來幫助時(shí)序收斂。InTime的方法,就是通過調(diào)整FPGA工具的編譯過...
在數(shù)字電路中,移位寄存器是一種在若干相同時(shí)間脈沖下工作的以觸發(fā)器為基礎(chǔ)的器件,數(shù)據(jù)以并行或串行的方式輸入到該器件中,然后每個時(shí)間脈沖依次向左或右移動一個...
課程6:Quartus II使用簡介與第一個工程實(shí)例
Quartus II支持Altera的IP核,包含了LPM/MegaFunction宏功能模塊庫,使用戶可以充分利用成熟的模塊,簡化了設(shè)計(jì)的復(fù)雜性、加快...
2019-12-23 標(biāo)簽:alteraip核quartus ii 3954 0
流水線縮短了在一個時(shí)鐘周期內(nèi)給的那個信號必須通過的通路長度,增加了數(shù)據(jù)吞吐量,從而可以提高時(shí)鐘頻率,但也導(dǎo)致了數(shù)據(jù)的延時(shí)。
鋯石FPGA A4_Nano開發(fā)板視頻:VGA外設(shè)的IP核定制
IP核有三種不同的存在形式:HDL語言形式,網(wǎng)表形式、版圖形式。分別對應(yīng)我們常說的三類IP內(nèi)核:軟核、固核和硬核。這種分類主要依據(jù)產(chǎn)品交付的方式,而這三...
鋯石FPGA A4_Nano開發(fā)板視頻:VGA外設(shè)的IP核的應(yīng)用
調(diào)用IP核能避免重復(fù)勞動,大大減輕工程師的負(fù)擔(dān),因此使用IP核是一個發(fā)展趨勢,IP核的重用大大縮短了產(chǎn)品上市時(shí)間。
數(shù)字設(shè)計(jì)FPGA應(yīng)用:調(diào)用IP核實(shí)現(xiàn)多數(shù)表決器
多數(shù)表決器常見于信號處理。例如,在自動控制中,對三個針對同一事物的信號使用多數(shù)表決器進(jìn)行運(yùn)算,并按照其中兩個一致的結(jié)果執(zhí)行。這樣既可以提高信號的可靠性(...
正點(diǎn)原子開拓者FPGA Qsys視頻:自定義IP核之?dāng)?shù)碼管(2)
該課程是正點(diǎn)原子團(tuán)隊(duì)編寫,詳細(xì)講解了quartus中的qsys。也可以從我頭像點(diǎn)進(jìn)去看FPGA verilog相關(guān)的視頻。
FPGA之軟核演練篇:內(nèi)置IP核之System ID的講解
軟核演練篇包含了哪些內(nèi)容:該篇以什么是軟核、什么是Qsys、如何構(gòu)建一個Qsys系統(tǒng)為切入點(diǎn),在該基礎(chǔ)上進(jìn)一步介紹了Nios II處理器的體系結(jié)構(gòu)、Qs...
FPGA之軟核演練篇:內(nèi)置IP核之PIO的實(shí)戰(zhàn)應(yīng)用講解
PIO即可自由組裝成一體電腦的新型準(zhǔn)電腦,它把顯示器、機(jī)箱、電源、光驅(qū)和鍵鼠融為一體,需自由購買CPU 、主板、硬盤、內(nèi)存等組裝成一體電腦的硬件系統(tǒng)開放平臺。
FPGA之軟核演練篇:內(nèi)置IP核之Interval Timer的理論原理講解
軟核演練篇包含了哪些內(nèi)容:該篇以什么是軟核、什么是Qsys、如何構(gòu)建一個Qsys系統(tǒng)為切入點(diǎn),在該基礎(chǔ)上進(jìn)一步介紹了Nios II處理器的體系結(jié)構(gòu)、Qs...
FPGA之軟核演練篇:內(nèi)置IP核之Interval Timer的應(yīng)用實(shí)戰(zhàn)講解
軟核演練篇包含了哪些內(nèi)容:該篇以什么是軟核、什么是Qsys、如何構(gòu)建一個Qsys系統(tǒng)為切入點(diǎn),在該基礎(chǔ)上進(jìn)一步介紹了Nios II處理器的體系結(jié)構(gòu)、Qs...
該篇不僅講解了如何使用Quartus II軟件、ModelSim和SignalTap II軟件,還講解了PLL、ROM、RAM和FIFO IP核的使用。...
鋯石FPGA A4_Nano開發(fā)板視頻:ROM IP核的使用講解
ROM 是 read only memory的簡稱,表示只讀存儲器。只讀存儲器(ROM)是一種在正常工作時(shí)其存儲的數(shù)據(jù)固定不變,其中的數(shù)據(jù)只能讀出,不能...
鋯石FPGA A4_Nano開發(fā)板視頻:FIFO IP核的使用講解
FIFO是隊(duì)列機(jī)制中最簡單的,每個接口上都存在FIFO隊(duì)列,表面上看FIFO隊(duì)列并沒有提供什么QoS(Quality of Service,服務(wù)質(zhì)量)保...
鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核JTAG-UART的講解
JTAG UART是要自己添加的一個IP核,通常用來是實(shí)現(xiàn)PC和Nios II系統(tǒng)間的串行通信接口,它用于字符的輸入輸出,在Nios II的開發(fā)調(diào)試過程...
鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核SystemID的講解
System ID用來在區(qū)域內(nèi)唯一標(biāo)識主機(jī)或路由器。在設(shè)備的實(shí)現(xiàn)中,它的長度固定為48bit(6字節(jié))。一般情況下,我們采用設(shè)備的router-id轉(zhuǎn)換...
鋯石FPGA A4_Nano開發(fā)板視頻:內(nèi)置IP核UART的理論原理講解
UART將要傳輸?shù)馁Y料在串行通信與并行通信之間加以轉(zhuǎn)換。作為把并行輸入信號轉(zhuǎn)成串行輸出信號的芯片,UART通常被集成于其他通訊接口的連結(jié)上。
編輯推薦廠商產(chǎn)品技術(shù)軟件/工具OS/語言教程專題
電機(jī)控制 | DSP | 氮化鎵 | 功率放大器 | ChatGPT | 自動駕駛 | TI | 瑞薩電子 |
BLDC | PLC | 碳化硅 | 二極管 | OpenAI | 元宇宙 | 安森美 | ADI |
無刷電機(jī) | FOC | IGBT | 逆變器 | 文心一言 | 5G | 英飛凌 | 羅姆 |
直流電機(jī) | PID | MOSFET | 傳感器 | 人工智能 | 物聯(lián)網(wǎng) | NXP | 賽靈思 |
步進(jìn)電機(jī) | SPWM | 充電樁 | IPM | 機(jī)器視覺 | 無人機(jī) | 三菱電機(jī) | ST |
伺服電機(jī) | SVPWM | 光伏發(fā)電 | UPS | AR | 智能電網(wǎng) | 國民技術(shù) | Microchip |
Arduino | BeagleBone | 樹莓派 | STM32 | MSP430 | EFM32 | ARM mbed | EDA |
示波器 | LPC | imx8 | PSoC | Altium Designer | Allegro | Mentor | Pads |
OrCAD | Cadence | AutoCAD | 華秋DFM | Keil | MATLAB | MPLAB | Quartus |
C++ | Java | Python | JavaScript | node.js | RISC-V | verilog | Tensorflow |
Android | iOS | linux | RTOS | FreeRTOS | LiteOS | RT-THread | uCOS |
DuerOS | Brillo | Windows11 | HarmonyOS |