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      標簽　>　modelsim

      modelsim

      +關(guān)注5人關(guān)注

      　　Mentor公司的ModelSim是業(yè)界最優(yōu)秀的HDL語言仿真軟件，它能提供友好的仿真環(huán)境，是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。它采用直接優(yōu)化的編譯技術(shù)、Tcl/Tk技術(shù)、和單一內(nèi)核仿真技術(shù)，編譯仿真速度快，編譯的代碼與平臺無關(guān)，便于保護IP核，個性化的圖形界面和用戶接口，為用戶加快調(diào)錯提供強有力的手段，是FPGA/ASIC設(shè)計的首選仿真軟件。

      文章：83個 瀏覽：48025次 帖子：174個

      modelsim技術(shù)

      鋯石FPGA A4_Nano開發(fā)板視頻：ModelSim軟件使用講解

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      Mentor公司的ModelSim是業(yè)界最優(yōu)秀的HDL語言仿真軟件，它能提供友好的仿真環(huán)境，是業(yè)界唯一的單內(nèi)核支持VHDL和Verilog混合仿真的仿真器。

      2019-09-27 標簽：fpga仿真器modelsim 2421 0

      在modelsim中指定賽靈思的仿真庫方法

      批命令 A、開始-運行：cmd 在DOS窗口輸入：“ compxlib –s mti_se –f all –l all –o c:\Modeltech ...

      2017-02-11 標簽：賽靈思Xilinxmodelsim 2221 0

      modelsim安裝運行patch閃退

      模擬器的安裝和運行是計算機科學中非常重要的一環(huán)。ModelSim是一種流行的數(shù)字電子設(shè)計自動化工具，用于驗證和仿真硬件設(shè)計。然而，有時安裝和運行Patc...

      2024-01-04 標簽：計算機操作系統(tǒng)ModelSim 2110 0

      如何用Python實現(xiàn)Vivado和ModelSim仿真自動化？

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      我們在Windows系統(tǒng)下使用Vivado的默認設(shè)置調(diào)用第三方仿真器比如ModelSim進行仿真時，一開始仿真軟件都會默認在波形界面中加載testben...

      2023-09-13 標簽：二進制仿真仿真器 2032 0

      介紹一種ISE聯(lián)合仿真轉(zhuǎn)換為Moldelsim單獨仿真的方法

      找到仿真頂層的tb文件，cut_through_top_tb。

      2023-01-29 標簽：FPGA設(shè)計asicModelSim 1975 0

      Modelsim的仿真之路(Memory小技能)

      許久沒更新了，間歇性來寫寫，還是繼續(xù)Modelsim中關(guān)于內(nèi)存的操作，涉及的文件可在文末自行獲取，本篇對應(yīng)memory的文件夾。

      2022-10-24 標簽：仿真MemoryModelSim 1878 0

      減少Xilinx Ise與Modelsim聯(lián)合仿真的錯誤方法

      減少Xilinx Ise與Modelsim聯(lián)合仿真的錯誤方法

      我們經(jīng)常使用Xilinx Ise與Modelsim聯(lián)合仿真，但是經(jīng)常出現(xiàn)一些由于庫沒有編譯而出現(xiàn)的錯誤！下面是我總結(jié)的方法：

      2017-02-11 標簽：XilinxModelsim 1702 0

      通過文件讀寫方式實現(xiàn)Matlab和Modelsim的聯(lián)合仿真的經(jīng)驗總結(jié)

      通過文件讀寫方式實現(xiàn)Matlab和Modelsim的聯(lián)合仿真的經(jīng)驗總結(jié)

      雖然Modelsim的功能非常強大，仿真的波形可以以多種形式進行顯示，但是當涉及到數(shù)字信號處理的算法的仿真驗證的時候，則顯得有點不足

      2017-02-11 標簽：FPGAMatlabModelsim 1686 0

      使用ModelSim軟件進行時序仿真

      通過該圖，我們可以看出，這個工程是我們之前做功能仿真的工程，當我們關(guān)閉 ModelSim之后，我們再次打開 ModelSim 這個軟件，它會自動記錄上一...

      2022-07-18 標簽：ModelSim時序仿真 1679 0

      使用modelsim時的問題分析

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      仿真對于FPGA設(shè)計來說至關(guān)重要，我們經(jīng)常使用modelsim來進行功能仿真或者時序仿真，這樣就需要將modelsim和設(shè)計軟件（quartus ii）...

      2024-10-24 標簽：FPGA仿真軟件 1637 0

      記利用compxlibgui工具編譯Xilinx庫

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      當ISE調(diào)用ModelSim進行仿真的時候，如果在FPGA設(shè)計中使用了Xilinx提供的的IP core或者其他的原語語句，ModelSim不添加Xil...

      2017-02-11 標簽：賽靈思XilinxModelSim 1615 0

      Modelsim的仿真之路

      對于仿真的激勵測試，其實會有代碼覆蓋率一說，不過我們平?？赡芨嗍枪δ芨采w，代碼覆蓋估計關(guān)注的人要少些，不過作為相對系統(tǒng)性的學習，還是大概看下這個功能吧~

      2022-10-24 標簽：仿真ModelSim代碼 1231 0

      傳統(tǒng)FPGA開發(fā)方式講解

      傳統(tǒng)FPGA開發(fā)方式講解

      對于一個軟件開發(fā)人員，可能聽說過 FPGA，甚至在大學課程設(shè)計中，可能拿FPGA做過計算機體系架構(gòu)相關(guān)的驗證，但是對于它的第一印象可能覺得這是硬件工程師...

      2023-07-27 標簽：fpga計算機ModelSim 957 0

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      • Protues
        Protues
        +關(guān)注
        Proteus軟件是英國Lab Center Electronics公司出版的EDA工具軟件（該軟件中國總代理為廣州風標電子技術(shù)有限公司）。它不僅具有其它EDA工具軟件的仿真功能，還能仿真單片機及外圍器件。
      • 靜電防護
        靜電防護
        +關(guān)注
        為防止靜電積累所引起的人身電擊、火災(zāi)和爆炸、電子器件失效和損壞，以及對生產(chǎn)的不良影響而采取的防范措施。其防范原則主要是抑制靜電的產(chǎn)生，加速靜電泄漏，進行靜電中和等。
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        +關(guān)注
      • FPGA芯片
        FPGA芯片
        +關(guān)注
        FPGA（Field－Programmable Gate Array），即現(xiàn)場可編程門陣列，它是在PAL、GAL、CPLD等可編程器件的基礎(chǔ)上進一步發(fā)展的產(chǎn)物。
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        +關(guān)注
        ArduBlock軟件是Arduino官方編程環(huán)境的第三方軟件，目前必須依附于Arduino軟件下運行，區(qū)別于Arduino文本式編程環(huán)境，ArduBlock是以圖形化積木搭建的方式編程的，這樣的方式會使編程的可視化和交互性加強，編程門檻降低，即使沒有編程經(jīng)驗的人也可以嘗試給Arduino控制器編寫程序。
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        FPGA開發(fā)板
        +關(guān)注
        FPGA開發(fā)板在基于MCU、定制ASIC和體積龐大的電線束來實現(xiàn)引擎及控制電子的系統(tǒng)方案已發(fā)展至接近其技術(shù)和應(yīng)用極限，汽車工業(yè)正面臨新的設(shè)計挑戰(zhàn)。過去汽車電子產(chǎn)品的開發(fā)周期是漫長的，而許多汽車制造商現(xiàn)正致力于在更短的時間內(nèi)，裝備消費者所需的新一代汽車。
      • PCB封裝
        PCB封裝
        +關(guān)注
        pcb封裝就是把 實際的電子元器件，芯片等的各種參數(shù)（比如元器件的大小，長寬，直插，貼片，焊盤的大小，管腳的長寬，管腳的間距等）用圖形方式表現(xiàn)出來，以便可以在畫pcb圖時進行調(diào)用。
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        +關(guān)注
        Quartus II 是Altera公司推出的綜合性CPLD/FPGA開發(fā)軟件，軟件支持原理圖、VHDL、VerilogHDL以及AHDL（Altera Hardware 支持Description Language）等多種設(shè)計輸入形式，內(nèi)嵌自有的綜合器以及仿真器，可以完成從設(shè)計輸入到硬件配置的完整PLD設(shè)計流程。
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        +關(guān)注
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        Artix-7
        +關(guān)注
        　　Artix-7 系列：相對于 Spartan-6 系列而言，Artix-7 系列功耗降低了一半， 成本降低了 35%，采用小型化封裝、統(tǒng)一的 Virtex 系列架構(gòu)，能滿足低成本大批量市場的性能要求，這也正是此前 ASSP、ASIC 和低成本 FPGA 所針對的市場領(lǐng)域。
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        +關(guān)注
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        +關(guān)注
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        +關(guān)注
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      • 面包板
        面包板
        +關(guān)注
        面包板是由于板子上有很多小插孔，專為電子電路的無焊接實驗設(shè)計制造的。由于各種電子元器件可根據(jù)需要隨意插入或拔出，免去了焊接，節(jié)省了電路的組裝時間，而且元件可以重復使用，所以非常適合電子電路的組裝、調(diào)試和訓練。
      • AXI
        AXI
        +關(guān)注
        AXI是一種總線協(xié)議，該協(xié)議是ARM公司提出的AMBA3.0協(xié)議中最重要的部分，是一種面向高性能、高帶寬、低延遲的片內(nèi)總線。它的地址/控制和數(shù)據(jù)相位是分離的，支持不對齊的數(shù)據(jù)傳輸，同時在突發(fā)傳輸中，只需要首地址，同時分離的讀寫數(shù)據(jù)通道、并支持Outstanding傳輸訪問和亂序訪問，并更加容易進行時序收斂。AXI是AMBA中一個新的高性能協(xié)議。
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        特性阻抗
        +關(guān)注
        特性阻抗又稱特征阻抗，它不是直流電阻，屬于長線傳輸中的概念。特性阻抗是射頻傳輸線影響無線電波電壓、電流的幅值和相位變化的固有特性，等于各處的電壓與電流的比值，用V/I表示。在射頻電路中，電阻、電容、電感都會阻礙交變電流的流動，合稱阻抗。電阻是吸收電磁能量的，理想電容和電感不消耗電磁能量。
      • 時鐘源
        時鐘源
        +關(guān)注
        時鐘源用來為環(huán)形脈沖發(fā)生器提供頻率穩(wěn)定且電平匹配的方波時鐘脈沖信號。它通常由石英 晶體振蕩器和與非門組成的正反饋振蕩電路組成，其輸出送至環(huán)形脈沖發(fā)生器。
      • AD采樣
        AD采樣
        +關(guān)注
        　　AD轉(zhuǎn)換采樣頻率指完成一次從模擬轉(zhuǎn)換到數(shù)字的AD轉(zhuǎn)換所需時間的倒數(shù)，模擬量可以是電壓、電流等電信號，也可以是壓力、溫度、濕度、位移、聲音等非電信號；而AD分辨率指數(shù)字量變化一個最小量時模擬信號的變化量。
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        　　Kintex-7系列：Kintex-7 系列是一種新型 FPGA，能以不到 Virtex-6 系列一半的價格實現(xiàn)與其相當性能，性價比提高了一倍，功耗降低了一半。
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      jf_72770048 jf_67841551 路＆人 f00357136 一熙綠

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