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Verilog HDL是一種硬件描述語(yǔ)言(HDL:Hardware Description Language),以文本形式來(lái)描述數(shù)字系統(tǒng)硬件的結(jié)構(gòu)和行為的語(yǔ)言,用它可以表示邏輯電路圖、邏輯表達(dá)式,還可以表示數(shù)字邏輯系統(tǒng)所完成的邏輯功能。
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2016-04-25 標(biāo)簽:Verilog HDL 527 0
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2016-04-25 標(biāo)簽:建模Verilog HDL 692 0
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2016-04-25 標(biāo)簽:建模Verilog HDL 661 0
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2016-04-25 標(biāo)簽:Verilog HDL 651 0
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2016-04-25 標(biāo)簽:Verilog HDL 741 0
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2016-04-25 標(biāo)簽:建模Verilog HDL門(mén)級(jí)電路 649 0
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2016-04-25 標(biāo)簽:UDPVerilog HDL 635 0
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