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　　Vivado設計套件，是FPGA廠商賽靈思公司2012年發(fā)布的集成設計環(huán)境。包括高度集成的設計環(huán)境和新一代從系統(tǒng)到IC級的工具，這些均建立在共享的可擴展數(shù)據(jù)模型和通用調試環(huán)境基礎上。

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vivado技術

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Vivado關聯(lián)第三方編輯器的方法

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跨時鐘域電路設計：多位寬數(shù)據(jù)通過FIFO跨時鐘域

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