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標(biāo)簽 > xilinx
Xilinx是全球領(lǐng)先的可編程邏輯完整解決方案的供應(yīng)商。Xilinx研發(fā)、制造并銷售范圍廣泛的高級集成電路、軟件設(shè)計工具以及作為預(yù)定義系統(tǒng)級功能的IP(Intellectual Property)核。
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XDMA/PCIE IP的定制和Block Design的搭建
上一篇內(nèi)容我們已經(jīng)對PCIE協(xié)議進(jìn)行了粗略的講解。那么不明白具體的PCIE協(xié)議,我們就不能在FPGA中使用PCIE來進(jìn)行高速數(shù)據(jù)傳輸了嗎?答案是否定的。...
賽靈思FPGA DIY系列(1):車牌號定位與識別系統(tǒng)
在智能交通領(lǐng)域,汽車牌照自動識別系統(tǒng)是道路交通智能化的重要因素,包括車牌定位、字符分割和字符識別三個主要部分。本項目主要探討車牌定位和字符分割兩個部分,...
2012-12-06 標(biāo)簽:matlab定位系統(tǒng)Xilinx 1.3萬 2
VHDL和verilog各有優(yōu)點,選擇一個,建議選擇verilog。熟練使用設(shè)計軟件,知道怎樣編譯、仿真、下載等過程。起步階段不希望報一些培訓(xùn)班,除非你...
使用aurora核的點對點通信應(yīng)用設(shè)計
Aurora 是一個很高效的低延遲點對點的串行協(xié)議,它使用了GTP收發(fā)器。它旨在隱藏GTP的接口細(xì)節(jié)和開銷。
FPGA實現(xiàn)基于Vivado的BRAM IP核的使用
? Xilinx公司的FPGA中有著很多的有用且對整個工程很有益處的IP核,比如數(shù)學(xué)類的IP核,數(shù)字信號處理使用的IP核,以及存儲類的IP核,本篇文章主...
與其他技術(shù)一樣,有關(guān)ASIC技術(shù)過時的報道是不成熟的。新的ASIC產(chǎn)品的數(shù)目可能有大幅度下降,但其銷售額仍然相當(dāng)高,尤其是在亞太區(qū)。此外,采用混合式方法...
XADC模擬輸入包括專用模擬輸入VP/VN和16組復(fù)用模擬信號輸入VAUX(15:0);XADC轉(zhuǎn)換結(jié)果可以通過動態(tài)重配接口(DRP)或者JTAG接口輸...
基于Xilinx Zynq UltraScale+ RFSoC ZCU216評估套件詳細(xì)內(nèi)容介紹
Zynq UltraScale+ RFSoC 是業(yè)界首款單芯片自適應(yīng)無線電平臺,在一款芯片內(nèi)集成射頻直采數(shù)據(jù)轉(zhuǎn)換器、單芯片軟決策前向糾錯核(SD-FEC...
xilinx ZYNQ7000系列基本開發(fā)流程之PS端
ZYNQ 芯片分為 PL 和 PS, PS 端的 IO 分配相對是固定的,不能任意分配,雖然 PS 端的 ARM 是硬核,但是在 ZYNQ 當(dāng)中也要將 ...
idelay2中按推薦配置,從DATAIN還是從IDATAIN輸入?yún)^(qū)別為是內(nèi)部延時還是從IO輸入,F(xiàn)IXED固定延時,idelay value先輸入0,...
全新升級款Zybo Zynq-7000 APSoC開發(fā)板應(yīng)用
支持reVISION堆棧,并附贈SDSoc License。提供[嵌入式視覺]應(yīng).....
板載最大支持32GB的DDR4(PL)端以及5GB DDR(PS端)。支持X16 PCIE接口,HTG-VSL1提供了三個Vita 57.4 FMC+...
Zybo board 開發(fā)經(jīng)驗分享第一季: 詳解硬件構(gòu)架
Zybo Board 是一塊具有 FPGA 同時又包含了 ARM Cortex-A9 雙核心的開發(fā)板。 在我們開始這一切之前,我們需要稍微了解一下這片開...
Xilinx Vivado HLS中Floating-Point(浮點)設(shè)計介紹
盡管通常Fixed-Point(定點)比Floating-Point(浮點)算法的FPGA實現(xiàn)要更快,且面積更高效,但往往有時也需要Floating-P...
教你如何進(jìn)行Xilinx SerDes調(diào)試
FPGA SERDES的應(yīng)用需要考慮到板級硬件,SERDES參數(shù)和使用,應(yīng)用協(xié)議等方面。由于這種復(fù)雜性,SERDES的調(diào)試工作對很多工程師來說是一個挑戰(zhàn)。
Xilinx ISE是如何調(diào)用ModelSim進(jìn)行仿真的
在我們用ModelSim仿真的時候經(jīng)常是修改一點一點修改代碼,這樣會造成一個無奈的操作循環(huán):修改代碼--->編譯代碼--->仿真設(shè)置--->進(jìn)入仿真頁面...
Xilinx IP核配置,一步一步驗證Xilinx Serdes GTX最高8.0Gbps
之前用serdes一直都是跑的比較低速的應(yīng)用,3.125Gbps,按照官方文檔一步一步來都沒出過什么問題,這次想驗證一下K7系列GTX最高線速8Gbps...
一文詳解Xilinx GTX/GTH及2D eye scan的基本原理
本文介紹Xilinx GT的一些概念,對GT沒有概念但是有時間的童鞋推薦先看一下此文(Xilinx 7系列FPGA 高速收發(fā)器GTX/GTH的一些基本概...
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