chinese直男口爆体育生外卖, 99久久er热在这里只有精品99, 又色又爽又黄18禁美女裸身无遮挡, gogogo高清免费观看日本电视,私密按摩师高清版在线,人妻视频毛茸茸,91论坛 兴趣闲谈,欧美 亚洲 精品 8区,国产精品久久久久精品免费

0
  • 聊天消息
  • 系統(tǒng)消息
  • 評論與回復(fù)
登錄后你可以
  • 下載海量資料
  • 學(xué)習(xí)在線課程
  • 觀看技術(shù)視頻
  • 寫文章/發(fā)帖/加入社區(qū)
會員中心
創(chuàng)作中心

完善資料讓更多小伙伴認(rèn)識你,還能領(lǐng)取20積分哦,立即完善>

3天內(nèi)不再提示

SelectIO該怎么來實(shí)現(xiàn)LVDS的詳細(xì)步驟

454398 ? 來源:FPGA2嵌入式 ? 作者:FPGA2嵌入式 ? 2020-12-25 14:21 ? 次閱讀
加入交流群
微信小助手二維碼

掃碼添加小助手

加入工程師交流群

作者: 做但不能忘思考,FPGA2嵌入式

當(dāng)我們使用一種新的IP核的時候,遇到的最大問題是:以前根本沒有接觸過的新東西,我們會感到恐懼,不知道如何下手。比如,SelectIO該怎么來實(shí)現(xiàn)LVDS的功能:

Step1,我們新加一個接收的SelectIO的IP核,界面如下圖:

Step2,打開IP核對應(yīng)的數(shù)據(jù)手冊和文檔來學(xué)習(xí)IP核的大致使用方法,見EDA中自帶的IP核你會快速用嗎?,根據(jù)參考的數(shù)據(jù)文檔我們大致配置好為:DDR模式2*4的LVDS_25接口,配置完后保存。

Step3,打開IP核對應(yīng)的Example工程,這個工程里面有對應(yīng)IP配置下生成的例子工程,有很大的參考價值,如下圖:

o4YBAF9uH1WAVTlpAAXs3M_tjqQ774.png

Step4,我們這時就可以看到Vivado自動生成的IP核工程,接著就可以學(xué)習(xí)這個工程。

Step5,這個工程里面有TestBench,這個是很有用的,可以通過功能仿真來加速IP核中的功能,特別是時序關(guān)系的學(xué)習(xí)。

下面就是通過功能仿真后看到LVDS的波形圖,通過這些波形圖,能很好的讓我們學(xué)習(xí)SelectIO中各個信號的功能和時序關(guān)系,有時候文檔中描述的無法正確的理解,借助仿真波形就迎刃而解。

通過仿真時序圖,我們能更加直觀的理解LVDS傳輸?shù)臄?shù)據(jù)時序圖,比上網(wǎng)查詢或看文檔快很多了。

總之,EDA工具生成的參考例程和TestBench能更好的幫助我們學(xué)習(xí)新的IP核,加速項目的開發(fā),這是新IP核學(xué)習(xí)的正確打開方式。

編輯:hfy


聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點(diǎn)僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學(xué)習(xí)之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
  • IP
    IP
    +關(guān)注

    關(guān)注

    5

    文章

    1850

    瀏覽量

    155037
  • eda
    eda
    +關(guān)注

    關(guān)注

    72

    文章

    3079

    瀏覽量

    181677
  • lvds
    +關(guān)注

    關(guān)注

    2

    文章

    1217

    瀏覽量

    69202
  • Vivado
    +關(guān)注

    關(guān)注

    19

    文章

    848

    瀏覽量

    70553
收藏 人收藏
加入交流群
微信小助手二維碼

掃碼添加小助手

加入工程師交流群

    評論

    相關(guān)推薦
    熱點(diǎn)推薦

    SNx5LVDS3xx高速差分線路驅(qū)動器:設(shè)計與應(yīng)用全解析

    SNx5LVDS3xx高速差分線路驅(qū)動器:設(shè)計與應(yīng)用全解析 在電子工程師的日常設(shè)計工作中,高速差分線路驅(qū)動器是實(shí)現(xiàn)高效數(shù)據(jù)傳輸不可或缺的組件。今天,我們就來深入探討一下SNx5LVDS3xx系列高速
    的頭像 發(fā)表于 12-17 17:40 ?425次閱讀

    液晶顯示屏LVDS接口JEIAD 、VESA、18bit LVDS關(guān)聯(lián)和區(qū)別

    分享下液晶顯示發(fā)展史上一個重要且有趣的階段。LVDS接口不同格式的形成,根本上是成本、帶寬和市場需求之間博弈和演進(jìn)的結(jié)果。 下面我將詳細(xì)解釋它們的歷史成因、關(guān)聯(lián)與區(qū)別。 核心概念:什么是LVDS接口
    發(fā)表于 08-30 09:13

    LVPECL與LVDS電平互連:直流與交流耦合設(shè)計指南

    1.?LVPECL?與LVDS?的互連 1.1 ??LVPECL?與LVDS?的直流耦合 LVPECL?到LVDS?的直流耦合結(jié)構(gòu)需要一個電阻網(wǎng)絡(luò),如圖5?中所示,設(shè)計網(wǎng)絡(luò)時有這樣幾
    的頭像 發(fā)表于 08-04 16:42 ?1069次閱讀
    LVPECL與<b class='flag-5'>LVDS</b>電平互連:直流與交流耦合設(shè)計指南

    如何調(diào)用C的接口封裝micropyton接口?

    microPython的庫比較少,無法滿足需求,請問調(diào)用C的接口封裝micropyton接口如何操作?能否提供詳細(xì)步驟? 你好,可以參考micropython官方的教程添加自定義的
    發(fā)表于 06-23 07:17

    Analog Devices Inc. ADN4620和ADN4621 LVDS 2.5Gb隔離器數(shù)據(jù)手冊

    集成了Analog Devices Inc. iCoupler?技術(shù),經(jīng)過增強(qiáng)實(shí)現(xiàn)高速運(yùn)行。技術(shù)為LVDS信號鏈提供即用型電流隔離。交流耦合和/或電平轉(zhuǎn)換到LVDS接收器和
    的頭像 發(fā)表于 06-20 13:51 ?1723次閱讀
    Analog Devices Inc. ADN4620和ADN4621 <b class='flag-5'>LVDS</b> 2.5Gb隔離器數(shù)據(jù)手冊

    ADN4650/ADN4651/ADN4652 5 kV/3.75 kV rms、600 Mbps雙通道LVDS隔離器技術(shù)手冊

    ADN4652是一款信號隔離式、低壓差分信號(LVDS)緩沖器,數(shù)據(jù)速率高達(dá)600 Mbps,并且具有極低的抖動。 器件集成 **i**Coupler技術(shù),增強(qiáng)了高速工作性能,可提供符合TIA/EIA-644-A標(biāo)準(zhǔn)的LVDS
    的頭像 發(fā)表于 06-03 16:11 ?1382次閱讀
    ADN4650/ADN4651/ADN4652 5 kV/3.75 kV rms、600 Mbps雙通道<b class='flag-5'>LVDS</b>隔離器技術(shù)手冊

    openstack搭建詳細(xì)步驟

    openstack搭建詳細(xì)步驟
    的頭像 發(fā)表于 05-07 14:05 ?1657次閱讀

    MAX9152 800Mbps、LVDS/LVPECL至LVDS、2 x 2交叉點(diǎn)開關(guān)技術(shù)手冊

    MAX9152 2 x 2交叉點(diǎn)開關(guān)專為需要高速、低功耗和低噪聲信號分配的應(yīng)用而設(shè)計。器件包括兩路LVDS/LVPECL輸入、兩路LVDS輸出和兩路用于設(shè)置差分輸入和輸出之間內(nèi)部連接的邏輯輸入。
    的頭像 發(fā)表于 04-16 10:47 ?949次閱讀
    MAX9152 800Mbps、<b class='flag-5'>LVDS</b>/LVPECL至<b class='flag-5'>LVDS</b>、2 x 2交叉點(diǎn)開關(guān)技術(shù)手冊

    BP神經(jīng)網(wǎng)絡(luò)的實(shí)現(xiàn)步驟詳解

    BP神經(jīng)網(wǎng)絡(luò)的實(shí)現(xiàn)步驟主要包括以下幾個階段:網(wǎng)絡(luò)初始化、前向傳播、誤差計算、反向傳播和權(quán)重更新。以下是對這些步驟詳細(xì)解釋: 一、網(wǎng)絡(luò)初始化 確定網(wǎng)絡(luò)結(jié)構(gòu) : 根據(jù)輸入和輸出數(shù)據(jù)的特性
    的頭像 發(fā)表于 02-12 15:50 ?1171次閱讀

    設(shè)計SO-8封裝的詳細(xì)步驟和注意事項

    設(shè)計 SO-8(Small Outline-8)芯片的 PCB 封裝需要遵循一定的規(guī)范和步驟。SO-8 是一種常見的表面貼裝封裝,具有 8 個引腳,引腳間距通常為 1.27mm(50 mil)。以下是設(shè)計 SO-8 封裝的詳細(xì)步驟
    的頭像 發(fā)表于 02-06 15:24 ?4969次閱讀
    設(shè)計SO-8封裝的<b class='flag-5'>詳細(xì)</b><b class='flag-5'>步驟</b>和注意事項

    開啟hyper v,開啟hyper v的詳細(xì)操作步驟

    就為大家介紹開啟hyperv的詳細(xì)操作步驟。 ? ?Hyper-V是微軟提供的虛擬化技術(shù),允許用戶在單一物理硬件上運(yùn)行多個操作系統(tǒng)。以下是開啟Hyper-V的詳細(xì)步驟,適用于Windo
    的頭像 發(fā)表于 01-23 10:01 ?5694次閱讀
    開啟hyper v,開啟hyper v的<b class='flag-5'>詳細(xì)</b>操作<b class='flag-5'>步驟</b>

    PLD設(shè)計流程的詳細(xì)步驟

    PLD(Programmable Logic Device,可編程邏輯器件)設(shè)計流程是指從設(shè)計概念到最終實(shí)現(xiàn)的一系列步驟,用于創(chuàng)建和驗(yàn)證可編程邏輯器件的功能。 1. 需求分析(Requirement
    的頭像 發(fā)表于 01-20 09:46 ?1889次閱讀

    如何通過LVDS連接器實(shí)現(xiàn)更穩(wěn)定、高效的信號傳輸

    LVDS連接器在現(xiàn)代電子設(shè)備中被廣泛應(yīng)用,尤其是在高速數(shù)據(jù)傳輸和高分辨率顯示領(lǐng)域。LVDS連接器通過差分信號傳輸技術(shù),能夠有效減少信號干擾,提高傳輸速率和傳輸距離。然而,要實(shí)現(xiàn)更穩(wěn)定、高效的信號傳輸
    的頭像 發(fā)表于 01-18 10:55 ?980次閱讀

    AN-1177: LVDS和M-LVDS電路實(shí)施指南

    電子發(fā)燒友網(wǎng)站提供《AN-1177: LVDS和M-LVDS電路實(shí)施指南.pdf》資料免費(fèi)下載
    發(fā)表于 01-15 16:37 ?0次下載
    AN-1177: <b class='flag-5'>LVDS</b>和M-<b class='flag-5'>LVDS</b>電路實(shí)施指南

    如何利用SN75LVDS83B實(shí)現(xiàn)RGB到LVDS的轉(zhuǎn)換?

    我們用的是18-bit的LCD顯示屏,CPU用的是AM3354,因此我們就想利用SN75LVDS83B實(shí)現(xiàn)RGB到LVDS的轉(zhuǎn)換。 同時我看了SN75
    發(fā)表于 01-07 07:47