本文轉(zhuǎn)載自: OpenFPGA微信公眾號(hào)
頭文件主要使用“文件包括”處理,所謂"文件包含"處理是一個(gè)源文件可以將另外一個(gè)源文件的全部?jī)?nèi)容包含進(jìn)來(lái),即將另外的文件包含到本文件之中。Verilog語(yǔ)言提供了`include命令用來(lái)實(shí)現(xiàn)"文件包含"的操作。
我在頭文件中定義了一個(gè)全局變量如下:

我在使用這個(gè)全局變量時(shí),始終提示找不到這個(gè)全局變量:

出現(xiàn)這個(gè)問(wèn)題,主要有兩方面原因:
1、頭文件類型需要注意:

其中箭頭部分可以修改類型。
2、引用錯(cuò)誤:
output reg [WIDTH-1:0] LED;
上面是錯(cuò)誤的,正確如下:
output reg ['WIDTH-1:0] LED;
其中第一個(gè)引起出錯(cuò)的可能比較小,試過(guò)用其他類型(Verilog源文件類型)也不會(huì)有問(wèn)題。
關(guān)于文件包含的使用注意以下幾點(diǎn):

審核編輯:何安
-
Vivado
+關(guān)注
關(guān)注
19文章
852瀏覽量
70754
發(fā)布評(píng)論請(qǐng)先 登錄
驅(qū)動(dòng)板PCB布線的注意事項(xiàng)
別讓這些細(xì)節(jié)毀了PCBA!焊接注意事項(xiàng)清單
美國(guó)Odyssey奧德賽電池充電注意事項(xiàng)全解析
IGBT器件的防靜電注意事項(xiàng)
依托raksmart服務(wù)器在多種系統(tǒng)上本地部署deepseek注意事項(xiàng)
iW1710驅(qū)動(dòng)設(shè)計(jì)方案與PCB布線注意事項(xiàng)
驅(qū)動(dòng)板設(shè)計(jì)注意事項(xiàng)
GD32單片機(jī)GPIO結(jié)構(gòu)及注意事項(xiàng)
Vivado下頭文件使用注意事項(xiàng)
評(píng)論