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探究關(guān)于數(shù)字電路的一些基礎(chǔ)知識

FPGA設(shè)計論壇 ? 來源:FPGA設(shè)計論壇 ? 作者:FPGA設(shè)計論壇 ? 2021-10-11 15:04 ? 次閱讀
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1.常用門電路圖

f6616508-2a45-11ec-82a8-dac502259ad0.png

2.邏輯代數(shù)的基本定理----化簡時比較好用

反演定理:對于任意一個邏輯式 Y,若將其中所有的“ ?“ 換成“+ ” ,“+ ”換成“ ? ” ,0換成 1,1換成 0 ,原變量換成反變量,反變量換成原變量,則得到的結(jié)果就是Y‘。

對偶定理:對于任意一個邏輯式 Y,若將其中所有的“ ?“ 換成“+ ” ,“+ ”換成“ ? ” ,0換成 1,1換成 0 ,得到的公式仍然成立,且稱為Y的對偶式Y(jié)d.為了證明兩個邏輯式相等 , 也可以通過證明它們的對偶式相等來完成。

3.化簡邏輯函數(shù)時幾個關(guān)鍵的公式(A’代表A的非)

公式化簡法化簡邏輯函數(shù)

A+BC=(A+B)·(A+C)利用此公式可得A+A‘B=A+B

A·(A+B)=A

AB+A’C+BCxxx=AB+A‘C 即:若兩個乘積項中分別包含 A和A’兩個因子,而這兩個乘積項的其余因子組成第三個乘積項時, 則第三個乘積項是多余的, 可以消去。

f6700932-2a45-11ec-82a8-dac502259ad0.png

(A+B)‘=A’B‘

卡諾圖化簡法

(1)注意畫卡諾圖采用的編碼是格雷碼

(2) A+A=A即圈起來的可以有重疊的部分

(3)最上與最下,最左與最右 是可以合并的

(4)0比較少時可以合并0得到Y(jié)’。

f68d6446-2a45-11ec-82a8-dac502259ad0.png

4.格雷碼與二進(jìn)制的轉(zhuǎn)換

二進(jìn)制---》格雷碼方法:高位不變(高位補(bǔ)0,異或后等價于不變),從低位開始相鄰兩位異或

f6d596da-2a45-11ec-82a8-dac502259ad0.png

格雷碼---》二進(jìn)制:高位不變,從高位往低位異或,注意箭頭

f6eaa0b6-2a45-11ec-82a8-dac502259ad0.png

5.線性反饋移位寄存器LSFR

f72a3c6c-2a45-11ec-82a8-dac502259ad0.png

例如F(x)=x4+x+1是指c4,c1和c0為1,畫出來的框圖如下。

f77882a0-2a45-11ec-82a8-dac502259ad0.png

m序列是最長線性反饋移位寄存器序列的簡稱。它是由帶線性反饋的移存器產(chǎn)生的周期最長的序列。由上例可見, 一般來說, 一個n級線性反饋移存器可能產(chǎn)生的最長周期等于(2^n-1)。且其初始狀態(tài)除了全0都可以。

編輯:jq

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原文標(biāo)題:關(guān)于數(shù)字電路的一些基礎(chǔ)知識

文章出處:【微信號:gh_9d70b445f494,微信公眾號:FPGA設(shè)計論壇】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

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