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硬件電路的理論分析

GReq_mcu168 ? 來源:物聯(lián)網(wǎng)全棧開發(fā) ? 作者:物聯(lián)網(wǎng)全棧開發(fā) ? 2022-07-14 14:39 ? 次閱讀
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背景

這幾天研究的產(chǎn)品的核心算法是發(fā)射和接收的正弦信號的相位差檢測。

STM32F407處理器上,通過DMA+SPI通信對接收和發(fā)射信號進(jìn)行高速采樣。

設(shè)計(jì)算法計(jì)算接收和發(fā)射信號的相位差。

用delphi改了一個(gè)簡單的調(diào)試用的上位機(jī)軟件。

下位機(jī)通過串口將采集到的A/D值以及計(jì)算結(jié)果發(fā)送給上位機(jī)。

上位機(jī)將數(shù)據(jù)以圖形界面顯示出來,同時(shí)對計(jì)算結(jié)果進(jìn)行統(tǒng)計(jì)分析,判斷算法的正確性,

并根據(jù)分析結(jié)果調(diào)整參數(shù)。

花了兩個(gè)晚上的時(shí)間,完成了上位機(jī)和下位機(jī)的算法設(shè)計(jì)、代碼編寫和調(diào)試。

08fca554-033c-11ed-ba43-dac502259ad0.png

用于產(chǎn)品調(diào)試的上位機(jī)軟件界面

電路分析

今天晚上開始分析測試結(jié)果。

第一步是和硬件電路的理論分析進(jìn)行比較。

09162c7c-033c-11ed-ba43-dac502259ad0.png

客戶設(shè)計(jì)的電路

輸入信號的頻率為4kHz-18kHz。

在該電路中,

C1、C2的阻抗為:

09273c38-033c-11ed-ba43-dac502259ad0.png

跟與其串聯(lián)的電阻R4相比,可以忽略不計(jì)。

同理,電容C8的阻抗為

093a5f52-033c-11ed-ba43-dac502259ad0.png

,跟R9相比,也可以忽略不計(jì)。

+3.3V通過R1、R3的分壓得到1.65V給軌對軌運(yùn)放ADA4841提供直流工作電平,使其可以通過單電源供電。

綜合考慮之后,可以得到該電路的交流通路,如下圖:

09519f96-033c-11ed-ba43-dac502259ad0.png

電路交流通路

相位分析

電阻R4,電容C6構(gòu)成高通濾波器,

傳遞函數(shù)為:

096325cc-033c-11ed-ba43-dac502259ad0.png

幅值函數(shù)為:

096ed354-033c-11ed-ba43-dac502259ad0.png

-3dB截止截止頻率為

097eb620-033c-11ed-ba43-dac502259ad0.png

098aee54-033c-11ed-ba43-dac502259ad0.png

幅頻特性曲線

相角函數(shù)為:

0a81cb8e-033c-11ed-ba43-dac502259ad0.png

0a96002c-033c-11ed-ba43-dac502259ad0.png

相頻特性

當(dāng)頻率為18KHz時(shí),運(yùn)放同相輸入端的電壓相對于輸入電壓的相位超前0aa8e052-033c-11ed-ba43-dac502259ad0.png,

幅度比值為1。

R9、R10、C7構(gòu)成低通濾波器,從運(yùn)放同相端到輸出端的傳遞函數(shù)為:

0ab5a9c2-033c-11ed-ba43-dac502259ad0.png

0ac6c14e-033c-11ed-ba43-dac502259ad0.png

幅頻特性曲線

0ada3f08-033c-11ed-ba43-dac502259ad0.png

相頻特性曲線

當(dāng)頻率為18KHz時(shí),運(yùn)放輸出端的電壓相對于同相輸入端電壓的相位滯后0af0d9e8-033c-11ed-ba43-dac502259ad0.png,幅度比值為16.25。

因此,當(dāng)頻率為18KHz時(shí),運(yùn)放輸出端與輸入信號的相位滯后0afff91e-033c-11ed-ba43-dac502259ad0.png。

AD4020差分輸入信號Vout+-Vout-與運(yùn)放輸出的差分信號V1+-V1-在頻率域滿足以下關(guān)系式:

0b12cc2e-033c-11ed-ba43-dac502259ad0.png

當(dāng)頻率為18KHz時(shí),AD4020輸入信號與運(yùn)放輸出信號相比相位滯后0b1f6b5a-033c-11ed-ba43-dac502259ad0.png,幅度比值為0.81。

綜上,處理電路導(dǎo)致相位滯后為0b2f3cb0-033c-11ed-ba43-dac502259ad0.png

0b3a7de6-033c-11ed-ba43-dac502259ad0.png

Multisum仿真

Multisum仿真與計(jì)算結(jié)果一致。

原文標(biāo)題:用于相位差檢測的處理電路理論計(jì)算分析

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審核編輯:彭靜
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原文標(biāo)題:用于相位差檢測的處理電路理論計(jì)算分析

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