chinese直男口爆体育生外卖, 99久久er热在这里只有精品99, 又色又爽又黄18禁美女裸身无遮挡, gogogo高清免费观看日本电视,私密按摩师高清版在线,人妻视频毛茸茸,91论坛 兴趣闲谈,欧美 亚洲 精品 8区,国产精品久久久久精品免费

0
  • 聊天消息
  • 系統(tǒng)消息
  • 評論與回復
登錄后你可以
  • 下載海量資料
  • 學習在線課程
  • 觀看技術(shù)視頻
  • 寫文章/發(fā)帖/加入社區(qū)
會員中心
創(chuàng)作中心

完善資料讓更多小伙伴認識你,還能領取20積分哦,立即完善>

3天內(nèi)不再提示

芯片后仿真要點

全棧芯片工程師 ? 來源:全棧芯片工程師 ? 2024-10-23 09:50 ? 次閱讀
加入交流群
微信小助手二維碼

掃碼添加小助手

加入工程師交流群

INNOVUS/ICC2吐出的netlist經(jīng)過Formal/LEC驗證后,Star-RC/QRC抽取RC寄生參數(shù)文件并讀入到Tempus/PT分別做func/mbist/scan時序sign-off,寫出SDF3.0用以后仿真,搭建后仿真的驗證環(huán)境,添加sc/io/macro的verilog model,仿真輸出VCD給Redhawk/Voltus做功耗/IR Drop分析。本文簡要敘述下后仿真要點:

-debug選項,為了導出VPD通常選擇-debug_pp;

f4495e44-90c0-11ef-a511-92fbcf53809c.png

-R表示編譯之后立即運行仿真;

-gui表示在仿真0時刻打開DVE界面;

-l表示記錄編譯過程日志,后跟日志文件名;

+incdir+表示文件搜索路徑;

+v2k表示支持verilog 2001標準;

-top設置編譯頂層模塊,后跟頂層module名,不是文件名;

-negdelay

f474b4a4-90c0-11ef-a511-92fbcf53809c.png

SDF文件中有負延遲時,若不加-negdelay會出現(xiàn)SDF Error: SDF Error: NegativeDELAY ignored and replaced by 0.

即VCS將負延時忽略,用0取代負值。加參數(shù)-negdelay 可消除負延遲導致的error,變成warning,但最終都不影響設計。

SDF Warning:Negative IOPATH DELAY A to Y ignored.

+neg_tchk支持負延遲檢查,主要是檢查holdtime,否則反標中會把負值忽略為0

f48cdfca-90c0-11ef-a511-92fbcf53809c.png

標準單元庫文件有兩種,譬如tsmc18_neg和tsmc18,前者支持neg_tchk負延時檢查,后者不支持。因為hold time check的值是負的,所以要進行negative timingcheck,否則默認將會使負值的hold time check改為0。為了滿足對hold time負值的檢查,在vcs仿真時需加上+neg_tchk這個option。

如果不加的話會產(chǎn)生下面的問題:

f4a29310-90c0-11ef-a511-92fbcf53809c.png

+maxdelays用SDF文件中的延遲,取代仿真庫中的延時(仿真庫中通常是建立時間1ns,保持時間0.5ns),取SDF文件中的最大延遲;

+mindelays用SDF文件中的延遲,取代仿真庫中的延時,取SDF文件中的最小延遲(保持時間檢查);

實際上,我們會出ss、ff、tt等數(shù)個sdf,每個sdf里面都只有類似{max::max}形式,因此,每個sdf只對應一種ss或ff形式的延時反標。

+sdfverbose顯示所有的sdf反標錯誤

+no_notifier關(guān)閉時序檢查函數(shù)中的不定態(tài)生成傳播,即通過這個參數(shù),如果有時序違規(guī),控制臺會報告,但不會影響邏輯功能的正確輸出。

+nospecify 消除所有延遲,只做網(wǎng)表的功能仿真可以用;

+notimingchecks只是消除延遲違規(guī)斷言,避免輸出不定態(tài),但延遲還在。因此+nospecify的作用包括了+notimingchecks;

f4d86a62-90c0-11ef-a511-92fbcf53809c.png

注意:+nospecify,加上該選項之后,所有的線延遲以及標準單元verilog文件中的固有延遲都沒有了,如果只是單純的不加sdf文件的話,標準單元verilog文件中的specify延遲還是有的。

+delay_mode_zero: Change all the delay specifications on all gates,switches, and continuous assignments to zero and change all module path delays to zero.

聲明:本文內(nèi)容及配圖由入駐作者撰寫或者入駐合作網(wǎng)站授權(quán)轉(zhuǎn)載。文章觀點僅代表作者本人,不代表電子發(fā)燒友網(wǎng)立場。文章及其配圖僅供工程師學習之用,如有內(nèi)容侵權(quán)或者其他違規(guī)問題,請聯(lián)系本站處理。 舉報投訴
  • 芯片
    +關(guān)注

    關(guān)注

    463

    文章

    53849

    瀏覽量

    463031
  • 仿真
    +關(guān)注

    關(guān)注

    54

    文章

    4450

    瀏覽量

    137906
  • 函數(shù)
    +關(guān)注

    關(guān)注

    3

    文章

    4413

    瀏覽量

    67194
  • 編譯
    +關(guān)注

    關(guān)注

    0

    文章

    691

    瀏覽量

    35013

原文標題:芯片后仿(一)

文章出處:【微信號:全棧芯片工程師,微信公眾號:全棧芯片工程師】歡迎添加關(guān)注!文章轉(zhuǎn)載請注明出處。

收藏 人收藏
加入交流群
微信小助手二維碼

掃碼添加小助手

加入工程師交流群

    評論

    相關(guān)推薦
    熱點推薦

    LTspice噪聲仿真要點

    這里是以LTspice為例看下如何進行噪聲仿真,以及相關(guān)要點。因為LTspice非常容易上手,最重要的,它是免費軟件,所以用它進行電路仿真比較常見。
    的頭像 發(fā)表于 11-01 11:24 ?7704次閱讀
    LTspice噪聲<b class='flag-5'>仿真要點</b>

    一文掌握集成電路封裝熱仿真要點

    本文要點要想準確預測集成電路封裝的結(jié)溫和熱阻,進而優(yōu)化散熱性能,仿真的作用舉足輕重。準確的材料屬性、全面的邊界條件設置、真實的氣流建模、時域分析以及實證數(shù)據(jù)驗證是成功進行集成電路封裝熱仿真的關(guān)鍵。要
    的頭像 發(fā)表于 05-18 08:12 ?3000次閱讀
    一文掌握集成電路封裝熱<b class='flag-5'>仿真要點</b>

    請問STM32F4系列有對PI/SI仿真要求的文件嗎?

    STM32F4系列有對PI/SI仿真要求的文件嗎?
    發(fā)表于 06-03 06:25

    STM32F4系列有對PI/SI仿真要求的文件嗎?

    STM32F4系列有對PI/SI仿真要求的文件嗎?比如PDN Targets and Decoupling Example SI信號要求
    發(fā)表于 07-02 06:26

    modelsim仿真關(guān)于仿真原型文件的求助

    如題,最近看很多modelsim的資料,很多時候仿真要添加仿真原型文件,比較困擾的是怎么選擇仿真原型文件,不同功能怎么對應相應的仿真原型文件呢,我發(fā)現(xiàn)很多資料都沒講清楚。
    發(fā)表于 03-09 22:31

    proteus 7可以仿真msp430f249嗎?哪位大神可以幫我解釋一下,msp430f249仿真要用哪個版本?感謝

    proteus 7可以仿真msp430f249嗎?哪位大神可以幫我解釋一下,msp430f249仿真要用哪個版本?感謝
    發(fā)表于 08-26 17:16

    ARM cortex 處理器本身仿真要注意什么

    ARM cortex 處理器本身仿真要注意什么,uvm仿真時處理器本身arm提供驗證list嗎?
    發(fā)表于 08-05 14:14

    串行鏈路仿真操作步驟

    單擊快捷圖標欄的齒輪圖標啟動仿真,仿真完畢,參考前文的前仿真中回波損耗和TDR阻抗曲線圖提取方法提取
    的頭像 發(fā)表于 02-02 16:32 ?3071次閱讀
    串行鏈路<b class='flag-5'>后</b><b class='flag-5'>仿真</b>操作步驟

    multisim使用要點

    電路仿真軟件使用要點
    發(fā)表于 06-19 16:27 ?3次下載

    Vivado仿真器進行混合語言仿真的一些要點

    本文主要介紹使用 Vivado 仿真器進行混合語言仿真的一些要點。
    發(fā)表于 08-01 09:25 ?1854次閱讀

    芯片仿真仿真的區(qū)別

    芯片設計中,前仿真仿真都是非常重要的環(huán)節(jié),但它們在功能和目的上存在明顯的區(qū)別。本文將詳細介紹前仿真
    的頭像 發(fā)表于 12-13 15:06 ?1.2w次閱讀

    calibre仿真參數(shù)提取

    進行仿真時,可以提取一些重要的仿真參數(shù),這些參數(shù)對于評估電路的性能非常重要。本文將詳細介紹在Calibre中提取仿真參數(shù)的方法和意義。
    的頭像 發(fā)表于 01-04 17:24 ?2391次閱讀

    芯片仿真deposit的用法簡析

    我們知道芯片上電,沒有POR復位的或者不帶復位的寄存器q端要么處于1,要么處于0狀態(tài),對于仿真機器而言就是x態(tài)。
    的頭像 發(fā)表于 02-29 10:51 ?6071次閱讀
    <b class='flag-5'>芯片</b><b class='flag-5'>后</b><b class='flag-5'>仿真</b>deposit的用法簡析

    fpga前仿真仿真的區(qū)別

    FPGA的前仿真仿真芯片設計和驗證過程中扮演著不同的角色,各自具有獨特的特點和重要性。
    的頭像 發(fā)表于 03-15 15:29 ?4269次閱讀

    IC設計中前仿真仿真的區(qū)別

    一個完整的電路設計中必然包含前仿真仿真兩個部分,它們都屬于芯片驗證中的關(guān)鍵環(huán)節(jié)。
    發(fā)表于 03-29 11:35 ?2745次閱讀