1.RDMA 傳輸系統(tǒng)架構(gòu)設(shè)計(jì)目的
隨著數(shù)據(jù)中心對(duì)于網(wǎng)絡(luò)帶寬和延遲的要求日益增長，傳統(tǒng)的 TCP/IP 網(wǎng)絡(luò)已無法滿足性能要求， RDMA 網(wǎng)絡(luò)則憑借其高帶寬、低延時(shí)的特性脫穎而出錯(cuò)誤!未找到引用源。相較于傳統(tǒng) TCP/IP 協(xié)議， RDMA 具有零拷貝、不需要 CPU 接入、消息基于事務(wù)等特點(diǎn)。
該系統(tǒng)架構(gòu)主要解決適合于FPGA端的RDMA傳輸。它支持FPGA之間，F(xiàn)PGA與PC之間高速通信。只需一根光纖（當(dāng)然,PC端需要轉(zhuǎn)接卡，將光纖轉(zhuǎn)入PC端，例如100G的CX455A-ECAT 100Gbe網(wǎng)卡 就可以）。它注重通用性強(qiáng)，性能優(yōu)越，非私有化協(xié)議設(shè)計(jì)，以便用戶后續(xù)升級(jí)或更換IP。

2. RDMA 協(xié)議與傳統(tǒng) TCP/IP 協(xié)議在通信過程中的區(qū)別
如圖 1 所示，左側(cè)部分為傳統(tǒng) TCP/IP 協(xié)議的通信過程，首先使操作系統(tǒng)進(jìn)入內(nèi)核態(tài)，而后傳輸?shù)臄?shù)據(jù)通過 BUFFER 拷貝進(jìn) TCP/IP 協(xié)議棧進(jìn)行組包處理，而后通過網(wǎng)卡（NIC）驅(qū)動(dòng)下發(fā)到網(wǎng)卡內(nèi)的 BUFFER。右側(cè)部分則為 RDMA 協(xié)議的通信過程，其將 RDMA 協(xié)議部署在融合以太網(wǎng)卡（RNIC）上，在對(duì)數(shù)據(jù)包的組裝和拆解過程中，不需要 CPU 及操作系統(tǒng)介入干預(yù)，也不需要進(jìn)行內(nèi)存拷貝操作。當(dāng)發(fā)送數(shù)據(jù)包時(shí)，直接由應(yīng)用程序通知網(wǎng)卡要發(fā)送的數(shù)據(jù)在內(nèi)存中的起始地址及數(shù)據(jù)長度，而后 RNIC 則讀取其已經(jīng)在內(nèi)存中注冊(cè)好的區(qū)域數(shù)據(jù)并依照協(xié)議規(guī)范進(jìn)行數(shù)據(jù)包的組裝及傳輸。

3.系統(tǒng)架構(gòu)如圖2：

圖2 系統(tǒng)架構(gòu)圖

對(duì)IP的簡單控制由Microblaze完成，DDR負(fù)責(zé)讀寫等數(shù)據(jù)緩存。該架構(gòu)也可以換成zynq的arm控制，便于后續(xù)NVMe oF開發(fā)。
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4測(cè)試

在xilinx開發(fā)平臺(tái)測(cè)試，網(wǎng)卡支持100G，選用的是CX455A-ECAT 100Gbe。該IP支持 RoCE V2。實(shí)測(cè)數(shù)據(jù)：
SEND71Gbps
READ91 Gbps（PC端給FPGA發(fā)包，受PC性能限制多一點(diǎn)）
WRITE 96 Gbps

審核編輯 黃宇