用于雜散信號消除的PLL頻率規(guī)劃
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發(fā)表于 01-13 14:19
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ADS5407雜散較差的原因？
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發(fā)表于 01-08 06:30
邊帶雜散和開關(guān)雜散的含義是什么？會對電路造成什么影響？
我在看ADC供電部分的時候，看到邊帶雜散和開關(guān)雜散這兩詞不知道它的含義。請問下大家它們的含義以及它們將會對電路造成什么影響？
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發(fā)表于 12-31 06:32
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發(fā)表于 12-16 06:23
DAC37J82輸出頻點(diǎn)48M處雜散無法減弱是什么原因？
我們調(diào)試DAC37J82，現(xiàn)在204B接口連接正常，輸出信號中心頻點(diǎn)正常，但是兩側(cè)48M處雜散很高，無法消除，幫分析一下原因。
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發(fā)表于 11-22 06:54
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在使用DAC39J82過程中我們發(fā)現(xiàn)DAC芯片在輸出是0—500M頻率信號時，在120MHZ以下沒有沒有雜散問題。在150M，200M，300M
發(fā)表于 11-22 06:07
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-20MHz處的點(diǎn)，頻率是40MHz,如將將頻寬打到200MHz時會看到其它諧波和雜散點(diǎn)，下圖輸出60M時有影響的點(diǎn)是40M，對SFDR的影響超過10dB。其它雜
發(fā)表于 11-18 06:37
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在測試評估版時，不同頻率下整數(shù)邊界雜散差別很大。
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發(fā)表于 11-13 07:43
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發(fā)表于 11-11 08:02
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發(fā)表于 11-11 06:48
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發(fā)表于 11-11 06:05
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