FPGA中軟核和硬核的意思

1、軟核（SoftIPCore）

軟核在EDA設計領域指的是綜合之前的寄存器傳輸級（RTL）模型;具體在FPGA設計中指的是對電路的硬件語言描述，包括邏輯描述、網(wǎng)表和幫助文檔等。軟核只經(jīng)過功能仿真，需要經(jīng)過綜合以及布局布線才能使用。其優(yōu)點是靈活性高、可移植性強，允許用戶自配置;缺點是對模塊的預測性較低，在后續(xù)設計中存在發(fā)生錯誤的可能性，有一定的設計風險。軟核是IP核應用最廣泛的形式。

2、硬核（HardIPCore）

硬核在EDA設計領域指經(jīng)過驗證的設計版圖;具體在FPGA設計中指布局和工藝固定、經(jīng)過前端和后端驗證的設計，設計人員不能對其修改。不能修改的原因有兩個：首先是系統(tǒng)設計對各個模塊的時序要求很嚴格，不允許打亂已有的物理版圖;其次是保護知識產(chǎn)權的要求，不允許設計人員對其有任何改動。IP硬核的不許修改特點使其復用有一定的困難，因此只能用于某些特定應用，使用范圍較窄。

IP中軟核和硬核的意思

1、軟核

IP軟核通常是用HDL文本形式提交給用戶，它經(jīng)過RTL級設計優(yōu)化和功能驗證，但其中不含有任何具體的物理信息。據(jù)此，用戶可以綜合出正確的門電路級設計網(wǎng)表，并可以進行后續(xù)的結構設計，具有很大的靈活性，借助于EDA綜合工具可以很容易地與其他外部邏輯電路合成一體，根據(jù)各種不同半導體工藝，設計成具有不同性能的器件。軟IP內(nèi)核也稱為虛擬組件（VC-VirtualComponent）。

2、硬核

IP硬核是基于半導體工藝的物理設計，已有固定的拓撲布局和具體工藝，并已經(jīng)過工藝驗證，具有可保證的性能。其提供給用戶的形式是電路物理結構掩模版圖和全套工藝文件，是可以拿來就用的全套技術。