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Spinal FPGA

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PCIe—Bar空間是怎么生效的

PCIe接口相對來講還是打交道比較多的接口。無論是Intel還是Xilinx的IP也都接觸到過。
的頭像 Spinal FPGA 發(fā)表于 06-05 10:47 ?7416次閱讀
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原來SpinalHDL中BlackBox封裝數(shù)組接口如此簡單

當(dāng)在SpinalHDL中調(diào)用別人的RTL代碼時,需要采用BlackBox進行封裝。對于大多數(shù)場景,想....
的頭像 Spinal FPGA 發(fā)表于 05-22 10:04 ?1061次閱讀
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淺析Stream里的隱式轉(zhuǎn)換

Stream、Flow是在電路描述里經(jīng)常用到的對象。
的頭像 Spinal FPGA 發(fā)表于 05-15 17:36 ?728次閱讀
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AMBA4 SystemVerilog Asseration驗證

ARM所推出的AMBA4總線相對來講還是應(yīng)用廣泛的。無論是芯片設(shè)計里還是FPGA設(shè)計里,時常能見到A....
的頭像 Spinal FPGA 發(fā)表于 05-05 15:37 ?1068次閱讀
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基于RR的多路分發(fā)調(diào)用

在SpinalHDL代碼中,StreamArbiter提供了完善的多入一出的調(diào)度機制。里面可能應(yīng)用的....
的頭像 Spinal FPGA 發(fā)表于 04-15 10:40 ?1366次閱讀

報文解析規(guī)則定義 流水線劃分提取方案

之前看一篇論文《A Fast Approach for Generating Efficient P....
的頭像 Spinal FPGA 發(fā)表于 04-08 14:15 ?1369次閱讀

在SpinalHDL中如何將ROM的初始化放置在RTL文件中?

在默認情況下,SpinalHDL在生成代碼時會同時生成一個bin文件及一個RTL代碼文件。在RTL代....
的頭像 Spinal FPGA 發(fā)表于 04-01 15:27 ?1281次閱讀

模擬IC設(shè)計的這些坑你都踩過嗎?

模擬IC是負責(zé)生產(chǎn)、放大和處理各類模擬信號的電路,工程師通過模擬電路把模擬信號放大縮小后,再全部記錄....
的頭像 Spinal FPGA 發(fā)表于 03-06 15:51 ?2583次閱讀

三分鐘教你快速處理沒有使用的端口信號

避不開的場景 如果熟悉SpinalHDL設(shè)計,那么都應(yīng)該清楚在SpinalHDL設(shè)計里,如果....
的頭像 Spinal FPGA 發(fā)表于 03-06 14:11 ?722次閱讀

淺入淺出DDR的容量規(guī)格

對于DDR的理解,最初簡單的以為無非一個大的數(shù)組,我會接口使用就OK了。不管各種概念天花亂墜,其總歸....
的頭像 Spinal FPGA 發(fā)表于 02-12 15:06 ?8642次閱讀

分享下SpinalHDL中SpinalConfig中的三項參數(shù)

當(dāng)我們采用SpinalSystemVerilog(demo0())的方式生成RTL代碼時其生成的代碼....
的頭像 Spinal FPGA 發(fā)表于 02-08 10:01 ?1868次閱讀

DataBusShift——數(shù)據(jù)移位下游說了算

在邏輯設(shè)計里,比如需要分層解析數(shù)據(jù)的場景,往往當(dāng)前時鐘能消耗處理多少數(shù)據(jù)依賴于數(shù)據(jù)的實時解析,下一拍....
的頭像 Spinal FPGA 發(fā)表于 12-05 10:36 ?851次閱讀

SpinalHDL中不可不知的位拼接符

在之前寫Verilog時,位拼接符是一個很常見的東西,今天來看下在SpinalHDL中常見的位拼接符....
的頭像 Spinal FPGA 發(fā)表于 11-12 11:34 ?1539次閱讀

RSS的邏輯實現(xiàn)

在網(wǎng)卡領(lǐng)域,多隊列技術(shù)已經(jīng)是一項很常用的技術(shù),而網(wǎng)絡(luò)報文的負載分流,常見的就是RSS。本文就索性仔細....
的頭像 Spinal FPGA 發(fā)表于 11-06 13:22 ?1854次閱讀

asBits函數(shù)如何轉(zhuǎn)換成Bits數(shù)據(jù)類型

SpinalHDL中Bundle與SystemVerilog中的packed struct很像,在某....
的頭像 Spinal FPGA 發(fā)表于 10-17 09:53 ?1071次閱讀

SpinalHDL中Bundle數(shù)據(jù)類型的轉(zhuǎn)換

SpinalHDL中Bundle與SystemVerilog中的packed struct很像,在某....
的頭像 Spinal FPGA 發(fā)表于 10-17 09:51 ?1642次閱讀

設(shè)計中DFX的重要性表現(xiàn)

這里我們假定對inPort端口添加一些監(jiān)控信息,我們設(shè)計如下模塊作為AxiLite4總線的一個通用監(jiān)....
的頭像 Spinal FPGA 發(fā)表于 10-09 10:25 ?2212次閱讀